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一种基于数字DAC校准的低失调动态比较器

消耗积分:3 | 格式:rar | 大小:0.78 MB | 2017-12-01

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　　随着IC制造工艺的进步，逐次逼近型（SAR）ADC由于其结构简单、功耗低、尺寸小等优点受到了越来越广泛的关注，而作为SAR ADC中最重要的模拟模块之一，比较器性能的好坏对整个ADC的性能有重要影响，因此比较器的设计异常重要。比较器的功耗和失调是最重要的两个指标。

　　比较器在SAR ADC整体功耗中占有相当大的比重，因此没有静态功耗的动态比较器更符合低功耗SAR ADC设计要求，但是，动态比较器的失调校准会变得更加困难，一方面是因为动态比较器的失调不仅包括静态失调，还包括动态失调，这部分失调只有在电路工作的瞬态才会表现出来。另一方面输入失调存储IOS （ln　put Offset Storage）、输出失调存储OOS（Output　Offset Storage）等常见的失调校准技术不能直接用于动态比较器的校准，这增加了实现高精度动态比较器的难度。

一种基于数字DAC校准的低失调动态比较器

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