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Altera FPGA教程之让你七天学会Altera FPGA的时序分析
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2018-09-12
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网上关于 Altera 的教程很多，可谓浩如烟海。大体来说有两类：一是，step by step 的指导如何操作 Quartus 软件，这类方法的优点是上手快，但却有知其然不知其所以然之惑；二是，从一个很高的起点分析一些具体问题，优点是有深度，但也把大部分初学者拒之门外，不知路在何方。
本系列教程的宗旨是在力求全面介绍 Altera 及其 QuartusII 软件原理的基础上，对何如使用 Altera FPGA 进行基础设计、时序分析、验证、优化四大方面进行讲解。
本篇为时序篇，推荐用两天时间掌握。其余的，基础篇需一天，验证、优化各需两天，一共七天。本教程大部分内容参考翻译altera官方handbook和对应的paper等资料，1.2、 1.4、1.6、2.1 系热心网友 riple 所创，笔者基本原文引用，只为阅读流畅性和更易理解做了少许改动，如造成原作者的不适，可联系笔者删除之。后续教程视读者反映情况进行适当调整和发布。
1. 时序分析基本概念
静态时序分析（Static Timing Analysis---STA）的前提是同步逻辑设计：通过路径计算延迟的总和，并比较相对于预定义时钟的延迟。静态时序分析仅关注时序间的相对关系而不是评估逻辑功能。
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