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7系列FPGA GTP收发器的可定制Logicore™IP Chipscope™Pro集成误码率测试（IBert）内核用于评估和监控GTP收发器。该核心包括在FPGA逻辑中实现的模式生成器和校验器，以及对端口的访问和GTP收发器的动态重新配置端口属性。还包括通信逻辑，允许通过JTAG对设计进行运行时访问。根据客户配置和本文档中的描述，此核心可以用作独立的或开放的设计。
特征
•在Chipscope Pro分析仪软件和Ibert核心之间提供通信路径
•提供用户可选择数量的7系列FPGA GTP收发器
•收发器可根据需要的线速率、参考时钟速率、参考时钟源和数据路径宽度进行定制。
•需要一个系统时钟，该时钟可以来自一个PIN或一个启用的GTP收发器。
Ibert核心设计用于需要验证或评估7系列FPGA GTP收发器的任何应用。
Ibert核心为7系列FPGA GTP收发器提供了一个广泛的物理介质附件（PMA）评估和演示平台。可参数化地使用不同的GTP收发器和时钟拓扑结构，ibert核心也可以定制为使用不同的线路速率、参考时钟速率和逻辑宽度。所需的每个GTP收发器都包含数据模式生成器和校验器，提供各种不同的伪随机二进制序列（PRB）和要通过信道发送的时钟模式。此外，可以通过与GTP收发器的DRP端口通信的逻辑访问GTP收发器的配置和调整，以更改属性设置，以及控制端口上的值的寄存器。在运行时，Chipscope Analyzer工具通过JTAG，使用作为Ibert核心一部分的xilinx电缆和专有逻辑与Ibert核心进行通信。
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