Intersil公司的ISL70001SEH是集成了MOSFET的辐射和SEE加固的高效同步降压稳压器,输入电压3V至5.5V,输出电压从0.8V到输入电压的〜85 %,TJ≤+ 150℃时的输出负载电流6A,效率大于90%,开关频率1MHz或500kHz,辐射剂量为100 krad(Si),SEL和SEB LETTH为86.4MeV / mg / cm2,主要用在FPGA,CPLD,DSP,CPU内核和I /本文介绍了ISL70001SEH的主要特性,方框图,主/从模式典型应用电路,以及辐射加固FPGA电源参考设计和VIRTEX5MEZPWREV1Z评估板布局,电路图,材料清单和PCB布局图。
Rad Hard和SEE Hard 6A同步降压稳压器ISL70001SEH
ISL70001SEH是经过辐射硬化和SEE硬化的具有集成MOSFET的高效单片同步降压稳压器。该单芯片电源解决方案在3V至5.5V的输入电压范围内工作,并提供严格调节的输出电压,该电压可在外部从0.8V至输入电压的〜85%进行调节。TJ 《+ 145℃时,输出负载电流容量为6A。
ISL70001SEH具有高集成度和一流的辐射耐受性,是为当今许多小型应用提供支持的理想选择。可以同步两个设备,以为需要独立内核和I / O电压的大规模数字IC(例如现场可编程门阵列(FPGA))提供完整的电源解决方案。
ISL70001SEH主要特性:
• 整个线路,负载,温度和辐射的参考电压为±1%
•电流模式控制可提供出色的动态响应
•完整的低温范围工作(TA = -55℃至+ 125℃)
•效率》 90%
•固定1MHz工作频率
•工作于3V至5.5V电源
•可调输出电压
-两个外部电阻将VOUT设置为VIN的0.8V至〜85%
•双向SYNC引脚允许两个器件异相同步180°
•器件使能具有比较器类型的输入
•电源正常输出电压监控器
•可调模拟软启动
•输入欠压,输出欠压和输出过流保护
•启动进入预偏置负载
•电气筛选符合DLA SMD 5962-09225
•QML符合MIL-PRF-38535要求
•辐射硬度
-总剂量[50-300rad(Si)/ s]。。。。。。。。。。.100krad(Si)min-
总剂量[《10mrad(Si)/ s]。。。。。。。。。。。。.50krad(Si)min
•SEE硬度
-SEL和SEB LETeff。。。。。。。。。。。。最小86.4MeV / mg / cm2
-SEFI X切片(LETeff = 86.4MeV / mg / cm2)1.4 x 10-6 cm2最大
-SET LETeff(《1脉冲扰动)86.4MeV / mg / cm2 min
ISL70001SEH应用:
•FPGA ,CPLD,DSP,CPU内核或I / O电压
•低压,高密度分布式电源系统
图1.ISL70001SEH框图
图2.ISL70001SEH典型应用示例
图3.ISL70001SEH 5V输入电压和主模式同步应用电路图
图4.ISL70001SEH 3.3V输入电压和从模式同步应用电路图
本应用笔记讨论了VIRTEX5MEZPWREV1Zboard,这是Intersil在辐射硬化环境中为FPGA供电的参考设计。该特定板经过优化,可为Xilinx的Virtex-5 FPGA供电,并具有ISL70001SRH和ISL70002SRH,抗辐射POL降压稳压器以及ISL75051RH抗辐射LDO。
Virtex-5需要由ISL70002SRH提供的1.0V内核电压,由ISL70001SRH提供的2.5V辅助电压和由ISL75051RH提供的3.3V I / O电压。
图5.VIRTEX5MEZPWREV1Z评估板位置
ISL70001SRH和ISL70002SRH均经过辐射硬化和SEE硬化,具有集成MOSFET的高效,单片同步降压稳压器。这些单芯片电源解决方案在3V至5.5V的输入电压范围内工作,并提供严格调节的输出电压,该电压可在外部从0.8V至输入电压的〜85%进行调节。ISL70001SRH可以提供高达6A(TJ≤+ 145°C)的输出电流,而ISL70002SRH可以提供高达12A(TJ≤+ 150°C)的输出电流。
ISL75051SRH是一款辐射硬化,低电压,高电流,单输出LDO,额定电流高达3.0A的连续输出电流。它可以在2.2V至6.0V的输入电压范围内工作,并能够通过外部电阻分压器提供0.8V至5V的输出电压。该器件可实现低至65mV的压差。
图6.VIRTEX5MEZPWREV1ZA评估板电路图(1)
图7.VIRTEX5MEZPWREV1ZA评估板电路图(2)
图8.VIRTEX5MEZPWREV1ZA评估板电路图(3)
图9.辐射加固FPGA电源解决方案参考设计
尺寸图VIRTEX5MEZPWREV1Z评估板材料清单:
图10.VIRTEX5MEZPWREV1Z评估板元件布局图
图11.VIRTEX5MEZPWREV1Z评估板元件布局图(空格)
责任编辑:gt
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