74ls193引脚图及功能表

　　74LS193芯片是同步四位二进制可逆计数器，它具有双时钟输入，并具有异步清零和异步置数等功能。

　　74ls193计数器工作原理：

　　193为可预置的十进制同步加/减计数器，共有54193/74193，54LS193/74LS193两种线路结构形式。其主要电特性的典型值如下：

　　193的清除端是异步的。当清除端（CLEAR）为高电平时，不管时钟端（CDOWN、CUP）状态如何，即可完成清除功能。

　　193的预置是异步的。当置入控制端（LOAD）为低电平时，不管时钟（CDOWN、CUP）的状态如何，输出端（QA－QD）即可预置成与数据输入端（A－D）相一致的状态。

　　193的计数是同步的，靠CDOWN、CUP同时加在4个触发器上而实现。在CDOWN、CUP上升沿作用下QA－QD同时变化，从而消除了异步计数器中出现的计数尖峰。当进行加计数或减计数时可分别利用CDOWN或CUP，此时另一个时钟应为高电平。

　　当计数上溢出时，进位输出端（CARRY）输出一个低电平脉冲，其宽度为CUP低电平部分的低电平脉冲；当计数下溢出时，错位输出端（BORROW）输出一个低电平脉冲，其宽度为CDOWN低电平部分的低电平脉冲。

　　当把BORROW和CARRY分别连接后一级的CDOWN、CUP，即可进行级联。

　　74ls193引脚图：

74LS193引脚图

　　74ls193引脚说明：

• 　　 BORROW错位输出端（低电平有效）
   
• 　　 CARRY进位输出端（低电平有效）
   
• 　　 CDOWN减计数时钟输入端（上升沿有效）
   
• 　　 CUP加计数时钟输入端（上升沿有效）
   
• 　　 CLEAR异步清除端
   
• 　　 A－D并行数据输入端
   
• 　　 LOAD异步并行置入控制端（低电平有效）
   
• 　　 QA－QD输出端
   

　　74ls193功能表：

74LS193功能表
 

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