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支持 JESD204A 数据转换器串行接口标准的低功耗、高速14位 ADC AD9644 和 AD9641 JESD204A 工业串行接口标准减少了数据转换器与 FPGA(现场可编程门阵列)等其它器件之间的数据输入/输出的数量。更少的互连使布局更简单,电路板尺寸更小,系统整体性能则不受影响。这些特性对于各种高速应用十分重要,包括便携式仪器仪表、超声设备、雷达、无线基础设施(GSM、EDGE、W-CDMA、LTE、CDMA2000、WiMAX、 TD-SCDMA)和软件定义无线电。
关于采用 JEDS204A 接口的双通道14位 80MSPS ADC AD9644
AD9644 在80 MSPS 时功耗为 423 mW,它采用多级、差分流水线架构,并集成了输出纠错逻辑。在70 MHz和80 MSPS 时,AD9644的SNR(信噪比)为73.7 dBFS,SFDR(无杂散动态范围)为92 dBc。JESD204A 编码数据速率最高可达每链路1.6 Gbps,AD9644 提供两种输出模式,支持每个ADC通道采用专用数据链路或者两个 ADC 通道共用一个数据链路。宽带宽、差分采样保持模拟输入放大器支持用户可选的各种输入范围,集成基准电压源则能简化设计考虑。占空比稳定器可用来补偿 ADC 时钟占空比的波动,使转换器保持出色的性能。AD9644 采用48引脚 LFCSP (7 mm x 7 mm)封装,额定温度范围为 -40°C 至 +85°C 工业温度范围。
AD9644 双通道14位ADC主要特性
?采样速率:80 MSPS
?14位分辨率
?两路可配置串行输出
?信噪比(SNR):73.7 dBFS(70 MHz、80 MSPS)
?无杂散动态范围(SFDR):92 dBc(70 MHz、80 MSPS)
?低功耗:每通道212 mW (80 MSPS)
?1.8V单电源供电
AD9644 和AD9641可以配合放大器、VGA和时钟驱动器使用,构成完整的信号链,例如:ADL5562 - 3.3 GHz超低失真RF/IF差分放大器、ADA4937-2 - 超低失真差分ADC驱动器、AD8372 - 可编程双通道VGA、AD9510 - 时钟分配IC和AD9520 - 集成VCO的CMOS输出时钟发生器。
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