PCB高频信号线的布线技巧

高速信号布线的时候，需要用到传输线理论，布线过程中，有些方法和传统的一般信号布线也有所不同，下面大致给出了一些高频信号线的布线技巧。

内容摘要

01

电源布局布线

数字电路很多时候需要的电流是不连续的，所以对一些高速器件就会产生浪涌电流。如果电源走线很长，则由于浪涌电流的存在进而会导致高频噪声，而此高频噪声会引入到其他信号中去。

而在高速电路中必然会存在寄生电感和寄生电容，因此该高频噪声最终会耦合到其他电路当中，而由于寄生电感的存在也会导致走线可以承受的最大浪涌电流的能力下降，进而导致有部分压降，有可能会使电路失能。

所以在数字器件前面加上旁路电容就显得尤为重要。电容越大，其在传输能量上是受限于传输速率的，所以一般会结合一个大电容和一个小电容一起，来满足全频率范围内。

PCB布线时小容量电容应靠近芯片供电电源引脚放置，且回流芯片参考地的PCB布线越短越粗更好，以降低引线寄生电感对高频噪声的退耦影响。大容量电容当然也是靠近芯片供电电源引脚放置更好，相比小容量电容而言，大容量电容可以稍远，即先小容量电容再大容量。

避免热点产生：信号过孔会在电源层和底层产生噪声，主要原因是过孔寄生电感，可能会改变噪声的回流路径，导致信号回流路径失控，地噪声变大。

过孔寄生电感与器件（尤其是功率器件）寄生电容谐振，产生高频寄生振荡噪声，过孔寄生电容与寄生电感参与谐振有时也会导致信号电流路径的改变，使辐射噪声面积变大，导致严重的辐射发射问题。

另外，不合理的放置过孔很有可能会使电源或者地平面某些区域的电流密度增加。而这些电流密度增加的地方我们称之为热点。所以，我们在设置过孔的时候要极力避免这种情况发生，以免平面被割裂，最终导致EMC的问题产生。 

通常最好的避免热点的办法就是网状式的放置过孔，如此电流密度均匀，同时平面不会隔离，回流路径就不会过长，也就不会产生EMC的问题。

02

走线的弯曲方式

弯曲布线规则

在高速信号PCB布线时，信号走线出现弯曲无可避免，但是应该减少弯曲的次数。弯曲PCB布线时，则采用钝角布线，或者采用弧线布线，避免采用锐角或者直角走线。

蛇形线设计

在布高速信号线时，我们经常通过走蛇形线来实现等长，同样的蛇形线也其实一种走线的弯曲。线宽，间距，以及弯曲方式都应该做合理的选择，间距应满足4W/1.5W规则的。

03

信号的串扰控制

高速信号线之间如果距离太近，很容易产生串扰耦合。有些时候因为布局、板框尺寸等原因，导致高速信号线之间的距离超过了最低要求距离，只能在靠近其瓶颈的地方尽量加大高速信号线之间的距离。其实，如果空间足够容许，则尽量加大两高速信号线之间的距离。

04

PCB布线的桩线（stub）

上拉电阻/下拉电阻产生的桩线

长的桩线就相当于一个天线，处理不当会产生很严重的EMC的问题。同时桩线也会造成反射，降低信号的完整度。

通常在高速信号线上面添加上拉或者下拉电阻的时候，会最容易产生桩线，而一般处理桩线的将走线可以菊花走线。

根据经验可知，如果桩线的长度大于1/10波长就可以当做一个天线了，此时就会成为一个问题。

高速信号连接器处产生的桩线

在高速信号连接器端子引脚处，也是最容易产生桩线的地方，尤其是多个连接器兼容设计过程中容易产生桩线，其最好的办法是在靠近第一个连接器的输出引脚增加串联电阻，当使用第一个连接器时，断开串联电阻，减少桩线长度。

高速信号的桩线不仅会造成信号的反射，还会引起差分阻抗的跌落，其原因是桩线与连接线缆呈现并联关系，造成阻抗的严重不连续。

自动化测试点产生的桩线

高速信号在满足自动化生产时，需要在高速信号线上增加自动化的测试点，高速信号的测试点及其PCB布线，就构成了高速信号的桩线。

其解决方案主要有：一是取消高速信号线上的测试点及其连接线。二是缩短测试点与端子引脚之间的PCB布线长度，或者将测试点直接放置在端子引脚上。

05

阻抗连续性控制

线宽突变造成的不连续

走线的阻抗值一般取决于其线宽以及该走线与参考平面之间的距离。走线越宽，其阻抗越小。而在一些接口端子或器件的焊盘，其原理同样适用。

当一个接口端子的焊盘和一根高速信号线连接时，如果此时焊盘特别大，而高速信号线特别窄，大焊盘则阻抗小，而窄的走线必然是大阻抗，在这种情况下就会出现阻抗不连续，阻抗不连续就会产生信号反射。

所以一般为了解决这个问题，都是在接口端子或者器件的大焊盘下面放置一个禁布铜皮,同时在另外一层放置该焊盘的参考平面，进而加大阻抗，使阻抗连续。

过孔造成的不连续

过孔是另外一种会产生阻抗不连续的源头。为了最小化这种效应，在内层和过孔连接的不需要的铜皮应该去除。

而这样的操作其实可以在设计的时候，通过CAD工具来消除或者联系沟通PCB加工厂家来消除不需要的铜皮，保证阻抗的连续性。

06

高速差分信号设计

对称性要求

高速差分信号线我们必须保证等宽、等间距来实现特定的差分阻抗值。所以在布差分信号线的时候尽量保证对称。

有时候，一些高速差分信号线需要串接耦合电容。该耦合电容同样需要对称布置，同时该耦合电容的封装不能过大，推荐使用0402、0603也可以接受，0805以上的电容或者并排电容最好不要使用。

器件与过孔引起的不连续要求

在差分线对内禁止布置过孔或者元器件，如果在差分线对内放置了过孔或者器件会产生EMC问题同时也会导致阻抗不连续。

通常，过孔会产生巨大的阻抗不连续，所以对于高速差分信号线对则尽量减少过孔，如果要使用过孔则对称布置。

等长设计要求

在一些高速信号接口，一般如总线等需要考虑其各信号线之间的到达时间以及时滞误差。例如，在一组高速平行总线中的所以数据信号线其到达时间，必须保证在一定的时滞误差以内，从来来保证其建立时间和保持时间的一致性。为了满足这一需求，我们必须要考虑等长。

而高速差分信号线对两信号线必须保证严格的时滞，否则很有可能通讯失败。故为了满足这一要求，可以通过蛇形线来实现等长，进而满足时滞要求。

蛇形线一般应该布置在失长的源头处，而不是远端。在源头处才能保证差分线的正负端的信号在大部分时间内都是同步传输的。

走线弯曲处是产生失长的源头之一。对于走线弯曲处，其实线等长的应靠近弯曲处(<=15mm)

如果有两个走线弯曲，且两者之间的距离<15mm，故此时两者的失长会互相补偿，故此时不用再做等长处理。

对于不同部分的高速差分信号线，应分别独立等长。过孔，串接耦合电容以及接口端子都会是高速差分信号线分成两部分，所以这个时候要特别注意。一定要分别等长。因为很多EDA软件在DRC的时候都只关注整个走线是否失长。

对于如LVDS显示器件等接口，会同时存在数对差分对，且差分对之间的时序要求一般都会特别严格，时滞要求特别小，所以，对于此类差分信号对我们要求一般在同一平面内进行补偿。因为不同层的信号传输速度是不同的。

有些EDA软件在计算走线长度时，会将焊盘内部的走线也会计算在长度之内，如果此时进行长度补偿，最终实际结果会失长。所以此时要特别注意，在使用一些EDA的软件的时候。

在任何时候，如果可以就一定选择对称出线进而避免需要最终为了等长而进行蛇形走线。

如果空间容许，尽量在短的差分线源头处加一个小的回环来实现补偿，而不是通过蛇形线来补偿。

编辑：黄飞