HMC987LP5E 1:9扇出缓冲器设计用于低噪声时钟分配

电子说

1.3w人已加入

描述

HMC987LP5E 1:9扇出缓冲器设计用于低噪声时钟分配。该器件旨在生成上升/下降时间小于100 ps的相对方波输出。HMC987LP5E具有低偏斜和抖动输出以及快速上升/下降时间,从而可以控制混频器、ADC/DAC或SERDES器件等下游电路的低噪声开关功能。这些应用中,当时钟网络带宽足够宽并允许方波切换时,噪底尤为重要。HMC987LP5E的输出以2 GHz驱动,其噪底为-166 dBc/Hz,相当于0.6 asec/rtHz抖动密度,或8 GHz带宽内的50 fs。

输入级可单端或差分驱动,可采用多种信号格式(CML、LVDS、LVPECL或CMOS),以及交流或直流耦合。输入级同样具有可调输入阻抗。该器件集成带有可调摆幅/功率电平的8路LVPECL输出和1路CML输出,步进为3 dB。

低噪声

各输出级可以通过硬件控制引脚或串行端口接口的控制使能或禁用,以便在不需要时节省电能。

应用

SONET、光纤通道、GigE时钟分配

ADC/DAC时钟分配

低偏斜和抖动时钟或数据扇出

无线/有线通信

电平转换

高性能仪器仪表

医疗成像

单端至差分转换

审核编辑 :李倩

 

打开APP阅读更多精彩内容
声明:本文内容及配图由入驻作者撰写或者入驻合作网站授权转载。文章观点仅代表作者本人,不代表电子发烧友网立场。文章及其配图仅供工程师学习之用,如有内容侵权或者其他违规问题,请联系本站处理。 举报投诉

全部0条评论

快来发表一下你的评论吧 !

×
20
完善资料,
赚取积分