芯片引脚图
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本电路是由4个主从触发器和用作除2计数器及计数周期长度为除6的3位2进制计数器所用的附加选通所组成。
本电路有选通的零复位输入。
为了利用本计数器的最大计数长度(十二进制),可将B输入同Qn输出连接,输入计数脉冲可加到输入A上,此时输出就如相应的功能表上所要求的那样。
是由4个主从触发器和用作除2计数器及计数周期长度为除6的3位2进制计数器所用的附加选通所组成。
用Q0,Q1,Q2实现六进制计数。 默认J,K接高电平才能工作,工作原理是J,K触发器,当J=K=1时每输入一个时钟,触发器翻转一次即输出Q电平跳变一次。所以Q0是0101变化,频率是CP0的一半即实现了二分频,Q0作为Q1的CP输入端。注意Q1的初始状态J=1,K=1.另外当J=0,K=1时,Q=0.
注1:测Ice时,所有输出开路,二个Ro输入瞬时接4.5V,然后接地,其它输入端接地。
注2:QA输出的测试条件是规定的lol加上B输入In的极限值。这样可以驱动B输入,并保持全扇出能力。
所有典型值均在Vec=5.0V,TA=25C下测量得出。
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