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在电力电子领域不断发展的今天,高性能栅极驱动器的需求日益增长。德州仪器(Texas Instruments)的UCC21520、UCC21520A隔离式双通道栅极驱动器凭借其卓越的性能和丰富的功能,成为了众多设计工程师的首选。今天,我们就来深入剖析这款产品,探讨其特点、应用以及设计要点。
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UCC21520、UCC21520A可在 -40°C 至 +150°C 的结温范围内稳定工作,这使其能够适应各种恶劣的工作环境。在开关性能方面,它表现出色,典型传播延迟仅为 33ns,最小脉冲宽度为 20ns,最大脉冲宽度失真 6ns。这意味着在高速开关应用中,能够快速准确地响应控制信号,有效降低开关损耗。
共模瞬态抗扰度(CMTI)大于 125V/ns,这使得驱动器在高噪声环境下能够可靠工作,有效避免因共模干扰而导致的误动作。同时,其浪涌抗扰度高达 10kV,能够承受瞬间的高能量冲击,增强了系统的稳定性和可靠性。
该驱动器具有 4A 峰值源电流和 6A 峰值灌电流输出能力,能够为功率 MOSFET、IGBT 和 SiC MOSFET 提供足够的驱动电流,确保这些功率器件能够快速、可靠地开关。
输入 VCCI 范围为 3V 至 18V,可与数字和模拟控制器方便地接口,实现更灵活的系统设计。输出 VDD 驱动电源最高可达 25V,并且提供 -5V 和 8V VDD UVLO 选项,增强了对电源电压的监控和保护。此外,还具备可编程重叠和死区时间控制、快速禁用功能,可满足不同应用场景下的功率排序和保护需求。
该产品计划获得多项安全认证,如符合 DIN EN IEC 60747 - 17(VDE 0884 - 17)的 8000Vₚₖ 加强隔离、符合 UL 1577 的 5.7kV RMS 1 分钟隔离以及符合 GB4943.1 - 2022 的 CQC 认证,为设计人员提供了更高的安全保障。
UCC21520、UCC21520A 的高性能和灵活性使其适用于多种应用场景:
UCC21520 和 UCC21520A 在输入和输出电源电路中都具备内部欠压锁定(UVLO)保护功能。当 VDD 偏置电压低于启动时的 (V_{VDDON}) 或启动后的 (V{VDD_OFF}) 时,输出将被强制拉低,确保在电源异常时不会出现误动作。同样,输入侧的 UVLO 保护也能保证在 VCCI 电压异常时,驱动器处于安全状态。这种保护机制有效地提高了系统的可靠性,避免了因电源波动而导致的设备损坏。
输入引脚(INA、INB 和 DIS)基于 TTL 和 CMOS 兼容的输入阈值逻辑,并且与 VDD 电源电压完全隔离。这使得输入信号能够轻松地与各种逻辑级控制信号接口,同时具备良好的噪声免疫力。在输出方面,两个通道可以独立控制,并且可以通过编程死区时间(DT)来防止上下桥臂的直通现象。死区时间可以通过将 DT 引脚连接到 VCCI 或在 DT 和 GND 之间连接可编程电阻来设置,为设计人员提供了灵活的控制方式。
输出级采用了独特的上拉和下拉结构。上拉结构在功率开关导通的米勒平台区域能够提供最大的峰值源电流,加速开关的导通过程。下拉结构则采用简单的 N 沟道 MOSFET,确保在关断时能够快速泄放电荷。这种结构设计使得驱动器能够在高速开关时提供高效的驱动能力,同时保证输出电压的稳定性和可靠性。
为了滤除由于非理想布局或长 PCB 走线引入的振铃,建议使用一个小的 (R{IN}-C{IN}) 输入滤波器。 (R{IN}) 的取值范围为 0Ω 至 100Ω, (C{IN}) 的取值范围为 10pF 至 100pF。在选择这些组件时,需要权衡好噪声免疫力和传播延迟之间的关系。
自举电容在每个开关周期中由 VDD 通过外部自举二极管充电,因此选择具有高电压、快速恢复和低正向压降的二极管非常重要。同时,建议使用一个自举电阻 (R_{BOOT}) 来限制充电电流和电压上升斜率,以确保驱动器的安全运行。
外部栅极驱动电阻 (R{ON} / R{OFF}) 用于限制寄生电感/电容引起的振铃、高电压/电流开关的 dv/dt 和 di/dt 以及体二极管反向恢复引起的振铃。通过合理选择这些电阻,可以微调栅极驱动强度,优化开关损耗,减少电磁干扰。
栅极到源极电阻 (R{GS}) 用于在栅极驱动器输出无电源或处于不确定状态时,将栅极电压拉低到源极电压,同时减轻由于米勒电流引起的 dv/dt 导通风险。该电阻的大小通常根据功率器件的 Vth 和 (C{GD}) 与 (C_{GS}) 的比值来确定。
VCCI、VDDA 和 VDDB 的旁路电容对于实现可靠性能至关重要。建议选择具有低 ESR 和低 ESL 的表面贴装多层陶瓷电容(MLCC),并根据不同的电源引脚和应用场景选择合适的电容值和电压额定值。
在功率转换器中,上下晶体管之间的死区时间设置对于防止动态开关时的直通现象非常重要。UCC21520 的死区时间设置可以通过 DT 引脚配置,但需要考虑系统的实际需求,包括外部栅极驱动电阻、直流母线开关电压/电流以及负载晶体管的输入电容等因素。
为了支持外部功率晶体管导通时的高峰值电流,必须将低 ESR 和低 ESL 电容靠近 VCCI 和 GND 引脚以及 VDD 和 VSS 引脚连接。同时,应尽量减小顶部晶体管源极和底部晶体管源极之间的寄生电感,以避免开关节点 VSSA(HS)引脚出现大的负瞬变。死区时间设置电阻 (R_{DT}) 及其旁路电容应靠近 DT 引脚放置,以确保准确的死区时间控制。
将晶体管栅极充电和放电的高峰值电流限制在最小的物理区域内,有助于降低环路电感,减少晶体管栅极端子上的噪声。栅极驱动器应尽可能靠近晶体管放置,以缩短信号传输路径。此外,还需要注意自举电容、自举二极管、局部 VSSB 参考旁路电容和低侧晶体管体/反并联二极管等高电流路径的布局,尽量减小这些环路的长度和面积。
为了确保初级和次级侧之间的隔离性能,应避免在驱动器器件下方放置任何 PCB 走线或铜箔。建议在 PCB 上进行切割,以防止可能影响隔离性能的污染。对于半桥或高侧/低侧配置,应尽量增加高侧和低侧 PCB 走线之间的爬电距离,以提高系统的安全性。
当驱动电压高、负载重或开关频率高时,UCC21520 或 UCC21520A 可能会消耗大量功率。合理的 PCB 布局可以帮助将热量从器件散发到 PCB 上,降低结到板的热阻。建议增加连接到 VDDA、VDDB、VSSA 和 VSSB 引脚的 PCB 铜箔面积,优先考虑增加 VSSA 和 VSSB 的连接面积。如果系统中有多层板,还可以通过多个适当尺寸的过孔将这些引脚连接到内部接地或电源平面。
UCC21520、UCC21520A 隔离式双通道栅极驱动器以其卓越的性能、丰富的功能和广泛的应用领域,为电力电子设计人员提供了一个强大而可靠的解决方案。在实际应用中,通过合理的设计和布局,可以充分发挥其优势,实现高效、稳定、可靠的系统设计。希望本文对广大电子工程师在使用该产品时有所帮助,大家在设计过程中有什么疑问或者经验,欢迎在评论区分享交流。
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