电子说
在电子设计领域,时钟发生器是确保系统稳定运行的关键组件。今天,我们将深入探讨德州仪器(Texas Instruments)推出的两款低抖动多时钟发生器——PLL1707和PLL1708,它们在音频和视频处理等应用中展现出了出色的性能。
文件下载:pll1708.pdf
PLL1707和PLL1708是低成本的锁相环(PLL)多时钟发生器,能够从27 - MHz的参考输入频率生成四个系统时钟。这两款器件除了模式控制不同外,使用相同的芯片且电气特性相同。PLL1707采用并行控制,而PLL1708则支持串行控制,为设计师提供了更多的选择。
两款器件均能从27 - MHz的主时钟输入生成四个系统时钟。PLL1707和PLL1708的SCKO0输出固定的33.8688 MHz时钟,而SCKO1、SCKO2和SCKO3的输出频率可根据采样频率进行调整。PLL1707支持的采样频率为32、44.1、48、64、88.2、96 kHz,PLL1708支持的采样频率更丰富,包括16、22.05、24、32、44.1、48、64、88.2、96 kHz。
这两款器件提供极低抖动、高精度的时钟,典型抖动仅为50 ps。低抖动性能对于高性能音频DAC和/或ADC至关重要,能够确保音频信号的高质量处理。
采用3.3 - V单电源供电,减少了外部电源组件的需求,降低了成本和电路板空间。
PLL1707可通过采样频率控制引脚进行控制,PLL1708则可通过串行模式控制引脚进行控制,满足不同应用场景的需求。
PLL1707和PLL1708适用于多种基于MPEG - 2的应用,如HDD + DVD录像机、DVD录像机、HDD录像机、DVD播放器、多媒体PC的DVD附加卡、数字HDTV系统和机顶盒等。这些应用通常需要27 - MHz的主时钟,而这两款器件能够为其提供所需的音频系统时钟。
输入逻辑电平与CMOS兼容,VIH为0.7VDD,VIL为0.3VDD。输出逻辑电平也与CMOS兼容,VOH在IOH = - 4 mA时为VDD - 0.4 V,VOL在IOL = 4 mA时为0.4 V。
主时钟频率为27 MHz,典型值在26.73 - 27.27 MHz之间。输入电平VIH为0.7 VCC,VIL为0.3 VCC。时钟抖动典型值为50 ps,上电时间在0.5 - 1.5 ms之间。
SCKO0输出固定的33.8688 MHz时钟,SCKO1、SCKO2和SCKO3的输出频率根据采样频率和器件型号有所不同。输出上升时间和下降时间典型值均为2.0 ns,输出占空比在45% - 55%之间。
电源电压范围为2.7 - 3.6 V,典型值为3.3 V。供电电流在19 - 25 mA之间,功耗在63 - 90 mW之间。PLL1708在所有CE[6:1]位为0时可进入掉电模式,功耗仅为350 - 550 μA。
PLL1707/8由双PLL时钟和主时钟发生器组成,能够从27 - MHz的主时钟生成四个系统时钟和两个缓冲的27 - MHz时钟。主时钟可以是连接在XT1和XT2之间的晶体振荡器,也可以是XT1的外部输入。如果使用外部主时钟,XT2必须开路。
器件具有内部上电复位电路,PLL1708的模式寄存器在上电复位时会初始化为默认设置。在复位期间,所有时钟输出在加电时间后以默认设置启用。
PLL1707采用并行模式(硬件模式)控制,可通过SR、FS1和FS2引脚选择采样频率组、采样率和SCKO1频率。PLL1708采用串行模式(软件模式)控制,通过MS、MC和MD三线接口进行控制,可实现更多的功能选择,如采样率选择(半采样率)、每个时钟输出的启用/禁用、掉电和SCKO1配置等。
文档中给出了抖动与采样频率、电源电压、自由空气温度和负载电容的关系曲线,以及占空比与电源电压和自由空气温度的关系曲线。这些曲线有助于设计师了解器件在不同工作条件下的性能变化,从而进行合理的设计和优化。
文档提供了PLL1707的典型连接电路,建议使用一个公共接地连接以避免闩锁或其他与电源相关的问题,并尽可能靠近器件进行电源旁路。此外,还给出了PLL1707/8在DVD播放器和HDD + DVD录像机中的应用框图,展示了如何为音频系统提供时钟。
该集成电路可能会受到ESD损坏,德州仪器建议对所有集成电路采取适当的防护措施,以避免因不当处理和安装导致的损坏。
设计师应根据具体应用需求选择合适的TI产品,并对应用进行设计、验证和测试,确保其符合适用标准和其他安全、法规要求。
总之,PLL1707和PLL1708是两款性能出色、功能丰富的多时钟发生器,能够为音频和视频处理等应用提供高质量的时钟信号。在实际设计中,设计师应充分考虑其电气特性、工作原理和应用要求,合理选择控制方式和外部组件,以实现最佳的系统性能。你在使用这两款器件时遇到过哪些问题呢?欢迎在评论区分享你的经验和见解。
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