电子说
在电子设计领域,DDR 内存的端接稳压器是确保系统稳定运行的关键组件之一。今天,我们就来详细探讨一下德州仪器(TI)的 LP2998/LP2998 - Q1 DDR 端接稳压器,看看它有哪些独特的特性和应用场景。
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LP2998 是一款线性稳压器,专为满足 JEDEC SSTL - 2 和 JEDEC SSTL - 18 规范,用于 DDR - SDRAM 和 DDR2 内存的端接而设计。同时,它还支持 DDR3 和 DDR3L VTT 总线端接,最低 (V_{DDO}) 为 1.35 V。该器件内置高速运算放大器,能对负载瞬变做出出色响应,输出级可防止直通现象,在 DDR - SDRAM 端接应用中,可提供 1.5 A 的连续电流和高达 3 A 的瞬态峰值电流。
AVIN 为内部控制电路供电,PVIN 专门为输出级提供轨电压以产生 (V_{TT})。这两个引脚可根据应用需求使用独立电源,不过 (PVIN) 必须等于或低于 (AVIN)。在 SSTL - 2 应用中,将 (AVIN) 和 (PVIN) 直接连接到 2.5 V 是一个不错的选择,可避免分别旁路两个电源引脚。
VDDQ 用于创建内部参考电压以调节 (V{TT}),通过两个内部 50 kΩ 电阻的分压器产生参考电压,确保 (V{TT}) 精确跟踪 (V_{DDQ}/2)。最佳实现方式是将其作为远程感应,直接连接到 DIMM 处的 2.5 V 轨,以确保参考电压精确跟踪 DDR 内存轨。
VSENSE 引脚用于改善远程负载调节。在大多数主板应用中,端接电阻通过长平面连接到 (V{TT}),若仅在 LP2998 输出端调节输出电压,长走线会导致显著的 IR 压降。将 VSENSE 引脚连接到总线中间,可改善整个端接总线的电压分布。若不使用远程负载调节,VSENSE 引脚仍需连接到 (V{TT}),同时要注意避免长 VSENSE 走线靠近内存,可在该引脚旁放置一个 0.1 μF 陶瓷电容以滤除高频信号。
SD 是低电平有效的关机引脚,拉低该引脚可使 (V{TT}) 呈三态。关机时,(V{TT}) 不应暴露在超过 (AVIN) 的电压下。该引脚拉低时,LP2998 的静态电流会降低,但 (V_{DDQ}) 会始终保持 100 kΩ 的恒定阻抗以产生内部参考电压。
VREF 提供内部参考电压 (V{DDQ}/2) 的缓冲输出,为北桥芯片组和内存提供参考电压。由于这些输入通常具有极高的阻抗,从 (V{REF}) 吸取的电流应很小。为改善性能,可在靠近该引脚处使用一个 0.1 μF 至 0.01 μF 的陶瓷旁路电容。在关机状态和热关断事件中,该输出仍保持活跃,以实现 Suspend to RAM 功能。
VTT 是调节后的输出,用于端接总线电阻,能够精确调节输出电压至 (V{DDQ}/2),并可吸收和提供电流。LP2998 设计用于处理高达 ± 3 A 的峰值瞬态电流,具有快速的瞬态响应。最大连续电流是 (V{IN}) 的函数,若预期瞬态持续时间超过最大连续电流额定值,应选择足够大的输出电容以防止电压过度下降。
可利用独立的 (V_{DDQ}) 引脚和内部电阻分压器,将输出级连接到 1.5 V 轨,(AVIN) 引脚连接到 2.2 V 至 5.5 V 轨。若不希望使用 1.5 V - 2.5 V 轨,也可将输出级连接到 3.3 V 轨,但需注意避免结温超过最大值。
同样利用独立的 (V_{DDQ}) 引脚和内部电阻分压器,输出级可连接到 1.8 V 轨,(AVIN) 引脚可连接到 3.3 V 或 5 V 轨。若连接到 3.3 V 轨,可提供更高的最大连续电流,但要注意热耗散问题。
大多数情况下,将所有输入轨连接到 2.5 V 轨可在功耗和元件数量及选择之间取得最佳平衡。若对功耗或效率有较高要求,可采用分离电源轨的方式,将输出级(PVIN)连接到较低的轨(如 1.8 V),模拟电路(AVIN)连接到较高的轨(如 2.5 V、3.3 V 或 5 V),但会降低最大连续电流。
若需要调节输出电压至其他标准(如 SSTL - 3),可使用反馈电阻从 (V{TT}) 到 (VSENSE) 引脚进行电平转换。通过调整电阻值,可实现 (V{TT}) 高于或低于内部参考电压 (V_{DDQ}/2)。
将 (V{DDQ}) 连接到 1.5 V 轨,(AVIN) 和 (PVIN) 连接到 2.5 V 轨,可产生约 0.75 V 的 (V{TT}) 和 (V_{REF}) 电压,用于端接电阻。
在 Quad data rate (QDR) 应用中,建议为每个通道使用一个专用的 LP2998,以简化布局并降低每个稳压器的内部功耗,同时每个 DIMM 组可使用来自相应稳压器的独立 (V_{REF}) 信号。
LP2998/LP2998 - Q1 DDR 端接稳压器凭借其丰富的特性、广泛的应用场景和灵活的电路设计,为电子工程师在 DDR 内存端接和电源设计方面提供了一个可靠的解决方案。在实际应用中,我们需要根据具体的需求和条件,合理选择引脚连接、电源配置和布局方式,以充分发挥该器件的性能优势。同时,要注意散热设计和 ESD 防护,确保系统的稳定性和可靠性。大家在使用过程中是否遇到过类似器件的其他问题呢?欢迎一起交流探讨。
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