LP2998/LP2998 - Q1 DDR 端接稳压器:设计与应用指南

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LP2998/LP2998 - Q1 DDR 端接稳压器:设计与应用指南

在电子设计领域,DDR 内存的端接稳压器是确保系统稳定运行的关键组件之一。今天,我们就来详细探讨一下德州仪器(TI)的 LP2998/LP2998 - Q1 DDR 端接稳压器,看看它有哪些独特的特性和应用场景。

文件下载:LP2998MR NOPB.pdf

一、产品概述

LP2998 是一款线性稳压器,专为满足 JEDEC SSTL - 2 和 JEDEC SSTL - 18 规范,用于 DDR - SDRAM 和 DDR2 内存的端接而设计。同时,它还支持 DDR3 和 DDR3L VTT 总线端接,最低 (V_{DDO}) 为 1.35 V。该器件内置高速运算放大器,能对负载瞬变做出出色响应,输出级可防止直通现象,在 DDR - SDRAM 端接应用中,可提供 1.5 A 的连续电流和高达 3 A 的瞬态峰值电流。

二、关键特性剖析

2.1 电气特性优势

  • 低输出电压偏移:无需外部电阻,能有效简化电路设计,降低成本和电路板空间占用。
  • 线性拓扑结构:提供稳定的输出电压,减少噪声干扰,提高系统的稳定性和可靠性。
  • 宽输入电压范围:(AVIN) 输入电压范围为 2.2 V 至 5.5 V,(PVIN) 可在 0 至 (AVIN) 之间变化,适应不同的电源环境。
  • 高精度参考电压输出:(V_{REF}) 输出为芯片组和 DIMM 提供稳定的参考电压,确保系统的精确运行。

2.2 功能特性亮点

  • Suspend to Ram (STR) 功能:通过低电平有效的关机(SD)引脚实现,当 SD 引脚拉低时,(V{TT}) 输出呈三态,提供高阻抗输出,而 (V{REF}) 仍保持活跃,可降低静态电流,实现节能效果。
  • 热关断保护:当结温超过热关断温度(典型值 165°C)时,器件进入关机状态,(V{TT}) 呈三态,(V{REF}) 保持活跃,防止器件因过热损坏,提高系统的安全性和可靠性。

2.3 ESD 保护与温度范围

  • ESD 保护:达到 H1C 级人体模型(HBM)静电放电分类水平,能有效抵抗静电干扰,保护器件免受静电损坏。
  • 宽温度范围:工作结温范围为 - 40°C 至 125°C,适用于各种恶劣的工业和汽车环境。

三、引脚功能详解

3.1 电源输入引脚(AVIN 和 PVIN)

AVIN 为内部控制电路供电,PVIN 专门为输出级提供轨电压以产生 (V_{TT})。这两个引脚可根据应用需求使用独立电源,不过 (PVIN) 必须等于或低于 (AVIN)。在 SSTL - 2 应用中,将 (AVIN) 和 (PVIN) 直接连接到 2.5 V 是一个不错的选择,可避免分别旁路两个电源引脚。

3.2 参考电压输入引脚(VDDQ)

VDDQ 用于创建内部参考电压以调节 (V{TT}),通过两个内部 50 kΩ 电阻的分压器产生参考电压,确保 (V{TT}) 精确跟踪 (V_{DDQ}/2)。最佳实现方式是将其作为远程感应,直接连接到 DIMM 处的 2.5 V 轨,以确保参考电压精确跟踪 DDR 内存轨。

3.3 反馈引脚(VSENSE)

VSENSE 引脚用于改善远程负载调节。在大多数主板应用中,端接电阻通过长平面连接到 (V{TT}),若仅在 LP2998 输出端调节输出电压,长走线会导致显著的 IR 压降。将 VSENSE 引脚连接到总线中间,可改善整个端接总线的电压分布。若不使用远程负载调节,VSENSE 引脚仍需连接到 (V{TT}),同时要注意避免长 VSENSE 走线靠近内存,可在该引脚旁放置一个 0.1 μF 陶瓷电容以滤除高频信号。

3.4 关机引脚(SD)

SD 是低电平有效的关机引脚,拉低该引脚可使 (V{TT}) 呈三态。关机时,(V{TT}) 不应暴露在超过 (AVIN) 的电压下。该引脚拉低时,LP2998 的静态电流会降低,但 (V_{DDQ}) 会始终保持 100 kΩ 的恒定阻抗以产生内部参考电压。

3.5 参考电压输出引脚(VREF)

VREF 提供内部参考电压 (V{DDQ}/2) 的缓冲输出,为北桥芯片组和内存提供参考电压。由于这些输入通常具有极高的阻抗,从 (V{REF}) 吸取的电流应很小。为改善性能,可在靠近该引脚处使用一个 0.1 μF 至 0.01 μF 的陶瓷旁路电容。在关机状态和热关断事件中,该输出仍保持活跃,以实现 Suspend to RAM 功能。

3.6 输出电压引脚(VTT)

VTT 是调节后的输出,用于端接总线电阻,能够精确调节输出电压至 (V{DDQ}/2),并可吸收和提供电流。LP2998 设计用于处理高达 ± 3 A 的峰值瞬态电流,具有快速的瞬态响应。最大连续电流是 (V{IN}) 的函数,若预期瞬态持续时间超过最大连续电流额定值,应选择足够大的输出电容以防止电压过度下降。

四、应用场景与电路设计

4.1 常见应用领域

  • DDR 内存端接:适用于 DDR1、DDR2、DDR3 和 DDR3L 内存的端接,确保内存信号的稳定传输。
  • 汽车信息娱乐系统:满足汽车环境下对稳定性和可靠性的要求,为汽车电子设备提供稳定的电源。
  • FPGA、工业/医疗 PC:在这些对电源质量要求较高的应用中,LP2998 可提供精确的电压调节和良好的瞬态响应。
  • SSTL - 18、SSTL - 2、SSTL - 3 和 HSTL 端接:支持多种逻辑电平的端接,具有广泛的适用性。

4.2 典型应用电路设计

4.2.1 DDR - III 应用

可利用独立的 (V_{DDQ}) 引脚和内部电阻分压器,将输出级连接到 1.5 V 轨,(AVIN) 引脚连接到 2.2 V 至 5.5 V 轨。若不希望使用 1.5 V - 2.5 V 轨,也可将输出级连接到 3.3 V 轨,但需注意避免结温超过最大值。

4.2.2 DDR - II 应用

同样利用独立的 (V_{DDQ}) 引脚和内部电阻分压器,输出级可连接到 1.8 V 轨,(AVIN) 引脚可连接到 3.3 V 或 5 V 轨。若连接到 3.3 V 轨,可提供更高的最大连续电流,但要注意热耗散问题。

4.2.3 SSTL - 2 应用

大多数情况下,将所有输入轨连接到 2.5 V 轨可在功耗和元件数量及选择之间取得最佳平衡。若对功耗或效率有较高要求,可采用分离电源轨的方式,将输出级(PVIN)连接到较低的轨(如 1.8 V),模拟电路(AVIN)连接到较高的轨(如 2.5 V、3.3 V 或 5 V),但会降低最大连续电流。

4.2.4 电平转换

若需要调节输出电压至其他标准(如 SSTL - 3),可使用反馈电阻从 (V{TT}) 到 (VSENSE) 引脚进行电平转换。通过调整电阻值,可实现 (V{TT}) 高于或低于内部参考电压 (V_{DDQ}/2)。

4.2.5 HSTL 应用

将 (V{DDQ}) 连接到 1.5 V 轨,(AVIN) 和 (PVIN) 连接到 2.5 V 轨,可产生约 0.75 V 的 (V{TT}) 和 (V_{REF}) 电压,用于端接电阻。

4.2.6 QDR 应用

在 Quad data rate (QDR) 应用中,建议为每个通道使用一个专用的 LP2998,以简化布局并降低每个稳压器的内部功耗,同时每个 DIMM 组可使用来自相应稳压器的独立 (V_{REF}) 信号。

五、电源与布局建议

5.1 电源建议

  • 输入电容:虽不是必需的,但为提高在大负载瞬变时的性能,防止输入轨电压下降,建议在靠近 PVIN 引脚处放置输入电容。对于铝电解电容,典型值推荐为 50 μF;陶瓷电容可选择 10 μF 且 X5R 或更好的类型。若 LP2998 靠近 2.5 V DC - DC 转换器输出的大容量电容,可减小输入电容值。若 (AVIN) 和 (PVIN) 分开,应在 PVIN 轨附近放置一个 47 μF 电容,并在 (AVIN) 轨上放置一个 0.1 μF 陶瓷电容以防止噪声耦合。
  • 输出电容:LP2998 对输出电容的大小和 ESR 不敏感,可根据应用和 (V_{TT}) 的负载瞬态响应要求选择。对于 SSTL 应用中的 DDR - SDRAM,建议选择大于 100 μF 且 ESR 较低的输出电容。常见的电容类型有铝电解电容、陶瓷电容和混合电容,可根据实际需求进行组合使用。

    5.2 布局建议

  • 电容放置:电源轨的输入电容应尽可能靠近 PVIN 引脚放置。
  • VSENSE 连接:VSENSE 应连接到需要调节的 (V_{TT}) 端接总线位置,对于主板应用,理想位置是端接总线的中心。
  • VDDQ 连接:(V{DDQ}) 可远程连接到 DIMM 或芯片组的 (V{DDQ}) 轨输入,以提供最准确的参考电压。
  • 散热设计:为提高散热性能,应使用足够的顶层铜来散热,从接地连接到内部接地层的大量过孔有助于散热,若制造标准允许,可在封装下方设置过孔。
  • VSENSE 走线:布线 (VSENSE) 走线时要注意避免拾取开关 I/O 信号的噪声,在靠近 (VSENSE) 引脚处放置一个 0.1 μF 陶瓷电容可过滤高频信号。
  • VREF 旁路:使用 0.01 μF 或 0.1 μF 陶瓷电容对 (V{REF}) 进行旁路,电容应尽可能靠近 (V{REF}) 引脚放置。

六、总结

LP2998/LP2998 - Q1 DDR 端接稳压器凭借其丰富的特性、广泛的应用场景和灵活的电路设计,为电子工程师在 DDR 内存端接和电源设计方面提供了一个可靠的解决方案。在实际应用中,我们需要根据具体的需求和条件,合理选择引脚连接、电源配置和布局方式,以充分发挥该器件的性能优势。同时,要注意散热设计和 ESD 防护,确保系统的稳定性和可靠性。大家在使用过程中是否遇到过类似器件的其他问题呢?欢迎一起交流探讨。

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