AD9518-3 6 输出时钟发生器深度解析：设计要点与应用洞察

在电子设计领域，时钟发生器是确保系统稳定运行的关键组件之一。ADI公司的AD9518-3 6 输出时钟发生器以其卓越的性能和丰富的特性，在众多应用场景中崭露头角。今天，我们就来深入剖析这款时钟发生器，为各位电子工程师的设计工作提供有价值的参考。

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一、功能特性概述

（一）基本特性强大

AD9518-3具有低相位噪声的锁相环（PLL），片上压控振荡器（VCO）的频率范围为1.75 GHz至2.25 GHz，同时也支持外接频率高达2.4 GHz的VCO/VCXO。它拥有1个差分或2个单端参考输入，具备参考监测能力，支持自动恢复和手动参考切换/保持模式，能接受高达250 MHz的LVPECL、LVDS或CMOS参考信号。其分布路径上设计有可编程延迟，支持数字或模拟锁检测功能，还配备了3对1.6 GHz的LVPECL输出。

（二）输出指标优秀

每个输出对都共享一个1到32的分频器，并具备粗相位延迟功能，累加输出抖动低至225 fs rms，通道间的偏斜小于10 ps。在电源上电时，所有输出能够自动同步，同时也支持手动输出同步。该芯片采用48引脚的LFCSP封装，工作温度范围为 - 40°C至 + 85°C。

二、规格参数详解

（一）电源要求严格

电源是芯片稳定工作的基础，AD9518-3的电源要求较为严格。其VS电源电压为3.3V ± 5%，VS_LVPECL电源电压标称值在2.5V至3.3V之间，VCP电源电压标称值在3.3V至5.0V之间。RSET引脚电阻标称值为4.12 kΩ，用于设置内部偏置电流；CPRSET引脚电阻标称值为5.1 kΩ，用于设置内部电荷泵电流范围；BYPASS引脚需连接一个220 nF的电容，用于内部LDO稳压器的旁路，以确保其稳定性。

（二）PLL特性突出

1. VCO性能

片上VCO的频率范围为1750 - 2250 MHz，VCO增益（KVCO）典型值为50 MHz/V，调谐电压（VT）范围为0.5 V至VCP - 0.5 V，频率推斥（开环）典型值为1 MHz/V。在不同的偏移频率下，VCO的相位噪声表现良好，例如在100 kHz偏移时，相位噪声典型值为 - 108 dBc/Hz；在1 MHz偏移时，典型值为 - 126 dBc/Hz。

2. 参考输入

参考输入支持差分模式和双单端模式。差分模式下，输入频率范围为0 - 250 MHz，输入灵敏度为250 mV p - p；双单端模式下，交流耦合时输入频率范围为20 - 250 MHz，直流耦合时为0 - 250 MHz，输入灵敏度为0.8 V p - p。每个参考输入引脚都有特定的自偏置电压和输入电阻，这些参数对于确保输入信号的稳定性至关重要。

3. 鉴相器与电荷泵

鉴相器（PFD）的输入频率有一定限制，其抗反冲脉冲宽度可通过寄存器设置。电荷泵（CP）的电流可编程，高值典型为4.8 mA，低值为0.6 mA，具有良好的绝对精度和电流匹配特性。

（三）时钟输入输出

1. 输入特性

时钟输入为差分输入，输入频率可高达2.4 GHz（高频分布）或1.6 GHz（分布模式），输入灵敏度为150 mV p - p，输入共模电压为1.3 - 1.8 V。这些参数确保了芯片能够准确地接收外部时钟信号。

2. 输出特性

LVPECL时钟输出的最大频率为2950 MHz，输出高电压（VOH）、输出低电压（VOL）和输出差分电压（VOD）都有明确的范围。在不同的频率下，输出的上升时间、下降时间、传播延迟和偏斜等参数也有相应的规定。

三、工作原理及配置

（一）PLL工作原理与配置

1. 基本原理

PLL是该芯片的核心部分，它由鉴相器、电荷泵、环路滤波器和VCO组成。鉴相器比较参考信号和反馈信号的相位差，输出一个与相位差成正比的电压信号，电荷泵根据这个电压信号对环路滤波器进行充电或放电，从而调整VCO的频率，使其输出信号的相位与参考信号一致。

2. 灵活配置

AD9518-3的PLL支持灵活配置，可适应不同的参考频率、PFD比较频率、VCO频率等。通过可编程寄存器设置R分频器、N分频器、PFD极性、抗反冲脉冲宽度、电荷泵电流等参数，以及设计外部环路滤波器，能够实现不同的应用需求。例如，在使用外部VCO时，需要通过寄存器设置PLL处于正常工作模式，并选择合适的参考输入和PFD极性，同时连接外部环路滤波器。

（二）不同工作模式配置

1. 高频时钟分布模式

当CLK或外部VCO频率大于1600 MHz时，芯片默认配置为PLL异步关机，输入通过VCO分频器连接到分布部分。此时，需要确保输入频率经过适当的分频后再进入通道分频器，以满足通道分频器的最大输入频率限制。

2. 外部VCO模式

使用外部VCO时，需将PLL设置为正常工作模式，选择合适的参考输入，设置R、N等参数，并连接外部环路滤波器。同时，要根据VCO的特性选择正确的PFD极性。

3. 内部VCO模式

在使用内部VCO时，必须进行VCO校准，以确保其性能最佳。通过设置相应的寄存器，可选择VCO分频器的分频比，确保输入到通道分频器的频率不超过其最大允许值。

四、数字锁检测与相关功能

（一）数字锁检测（DLD）

DLD功能可通过引脚的复用选择在LD、STATUS和REFMON引脚实现。当PFD输入的上升沿时间差小于指定的锁定阈值时，DLD电路指示锁定；当时间差超过解锁阈值时，指示失锁。锁定检测窗口的时间取决于数字锁检测窗口位、抗反冲脉冲宽度设置和锁定检测计数器的设置。为了确保DLD正常工作，PFD频率的周期必须大于解锁阈值。

（二）模拟锁检测（ALD）

芯片提供了两种ALD功能：N沟道开漏锁检测和P沟道开漏锁检测。这两种检测方式都需要通过RC滤波器来提供锁定/解锁的逻辑电平指示。

（三）电流源数字锁检测

在某些应用中，可能希望在PLL完全锁定后才使DLD有效，这时可以使用电流源数字锁检测功能。通过选择LD引脚的输出模式，在DLD为真时提供110 μA的电流，为假时短路到地。通过连接一个电容到LD引脚，可以延迟锁定检测指示，直到PLL稳定锁定。

五、时钟分布功能

（一）输出通道配置

AD9518-3有三个通道，每个通道有两个LVPECL输出，共六个输出。每个通道都有一个可编程分频器，可实现2至32的整数分频，也可旁路以实现1分频。在使用通道分频器时，若内部VCO频率高于通道分频器的最大输入频率（1600 MHz），则必须使用VCO分频器。

（二）时钟源选择

时钟分布的输入源可以是内部VCO或外部CLK。当选择内部VCO时，必须使用VCO分频器；当选择CLK时，如果CLK频率小于通道分频器的最大输入频率，则可以不使用VCO分频器。通过寄存器设置可以灵活选择时钟源和分频模式。

（三）频率分频与相位延迟

1. 频率分频

总频率分频是VCO分频器和通道分频器的组合。通道分频器不仅可以实现分频功能，还可以选择不同的占空比和相位偏移。

2. 相位延迟

每个通道分频器都可以设置相位偏移，通过设置寄存器位来确定输出信号相对于输入信号的延迟。同步功能可以使输出信号的相位偏移生效，确保多个输出信号之间的相位关系符合设计要求。

六、复位与功耗管理

（一）复位模式多样

1. 上电复位

当电源VS开启时，芯片会进行上电复位（POR），将寄存器初始化为默认值，并执行同步操作，使输出信号按照默认设置进行相位对齐。

2. 异步复位

通过将RESET引脚短暂拉低，可以执行异步硬复位，将芯片寄存器恢复到默认设置。

3. 软复位

通过向寄存器0x000[2]和寄存器0x000[5]写入1b来执行软复位，该位需要手动清除以完成复位操作。软复位可以恢复内部寄存器的默认值。

（二）功耗管理灵活

1. 芯片电源关断

将PD引脚拉低可以使芯片进入电源关断模式，此时大多数功能和电流都被关闭，但LVPECL输出仍保持在安全关断模式。当PD引脚恢复到高电平时，芯片将恢复到之前编程的设置。

2. PLL电源关断

PLL部分可以通过寄存器设置进行选择性电源关断，支持异步和同步电源关断模式。

3. 分布部分和个别输出关断

分布部分可以通过寄存器设置进行电源关断，个别时钟输出也可以单独进行电源关断。不同的电源关断模式可以根据实际应用需求进行选择，以实现功耗的优化。

七、应用信息

（一）频率规划要点

在进行频率规划时，要充分利用AD9518的四个分频器：参考（R）分频器、反馈（N）分频器、VCO分频器和通道分频器。当需要实现较大的频率分频比时，可以合理分配这些分频器的分频值，以提高相位检测器频率和选择环路带宽的灵活性。一般来说，选择较低的VCO频率可以降低相位噪声和抖动，但较高的VCO频率可能在频率规划上提供更多的灵活性。同时，选择中等的电荷泵电流作为起点，可以方便地调整PLL环路带宽。

（二）ADC时钟应用

高速ADC对采样时钟的质量非常敏感，时钟的噪声、失真和抖动会直接影响ADC的性能。AD9518的LVPECL输出提供了差分时钟输出，能够有效降低噪声干扰，提高ADC的信噪比。在选择时钟/转换器解决方案时，需要考虑ADC的输入要求，如差分或单端输入、逻辑电平、终端匹配等。

（三）LVPECL时钟分布

LVPECL输出需要进行直流终端匹配，以偏置输出晶体管。常见的终端匹配方案有远终端Thevenin终端匹配和Y终端匹配。在应用中，需要确保接收缓冲器的VS与AD9518的VS_LVPECL电压匹配，否则建议采用交流耦合。同时，要注意选择合适的下拉电阻，避免损坏LVPECL驱动。

AD9518-3是一款功能强大、性能卓越的时钟发生器，在设计过程中，我们需要深入理解其功能特性、规格参数、工作原理和应用要点，充分发挥其优势，为电子系统的设计提供稳定、可靠的时钟信号。希望本文能为各位电子工程师在使用AD9518-3时提供有益的帮助，大家在实际应用中遇到任何问题，欢迎一起交流探讨。