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在电子设计领域,时钟发生器是确保系统稳定运行的关键组件之一。今天,我们将深入探讨Analog Devices的AD9551多功能时钟发生器,了解其特性、工作原理、应用场景以及设计要点。
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AD9551是一款功能强大的时钟发生器,能够实现任意两种标准网络速率之间的转换。它具备双参考输入和双时钟输出,支持多种操作模式,适用于多业务交换机、多业务路由器等多种应用场景。
AD9551采用两级级联PLL架构。第一级由分数分频(通过SDM)和基于晶体谐振器的DCXO数字PLL组成,DCXO依赖19.44 MHz至52 MHz的外部晶体,工作在晶体谐振频率附近的窄频率范围(±50 ppm),具有约180 Hz的环路带宽,可对输入参考信号进行初始抖动清理。第二级是频率倍增PLL,将第一级输出频率(19.44 MHz至104 MHz)提升至约3.7 GHz,通过基于SDM的分数反馈分频器实现分数频率倍增,可编程整数分频器最终将输出频率设定为最高900 MHz。
AD9551包含参考信号处理模块,可实现两个参考输入之间的平滑切换。该模块自动检测参考输入信号的存在,若只有一个输入,则将其作为活动参考;若两个输入都存在,则一个为活动参考,另一个为备用参考。当活动参考失效时,会自动切换到备用参考,反之亦然。
当两个参考信号都不可用时,AD9551支持保持模式。此时,外部晶体为切换和保持功能提供时钟源,设备在保持模式下维持稳定的输出信号,直到参考信号恢复。
参考时钟输入频率范围为19.44 MHz至806 MHz,输入电容典型值为3 pF,输入电阻典型值为6 kΩ,占空比范围为40%至60%。
在不同频率范围内,抖动生成指标表现良好,如在12 kHz至20 MHz范围内,抖动典型值为1.3 ps rms(fIN = 19.44 MHz,fOUT = 622.08 MHz)。
晶体频率范围为19 - 52 MHz,公差为20 ppm,晶体运动电阻为100 Ω,DCXO负载电容控制范围为3 - 21 pF。
总电流典型值为195 mA(最大输出频率且两个输出通道均激活),不同引脚的VDD电流也有相应的典型值。
AD9551能够精确实现网络时钟频率转换,为多业务交换机和路由器提供稳定的时钟信号,确保数据的准确传输和处理。
在需要进行频率转换的各种通用应用中,AD9551的灵活性使其能够满足不同的频率需求。
通过外部控制引脚(A[3:0]、B[3:0]和Y[3:0])可设置预定义的分频值,实现特定的输入 - 输出频率比。对于其他频率比需求,可通过串口进行编程。
外部晶体的选择至关重要,其谐振频率应在19.44 MHz至52 MHz范围内,且负载电容和频率公差需满足要求,以确保DCXO的正常工作。
输出PLL环路滤波器需要连接外部电容,正常模式下使用12 nF电容,19.44 MHz模式下使用100 nF电容,并需调整输出PLL电荷泵电流。
AD9551的串行控制端口支持单字节或多字节传输,以及MSB先或LSB先的传输格式。使用时需注意指令字的格式和操作流程,以及寄存器的读写操作。
AD9551作为一款多功能时钟发生器,凭借其灵活的频率转换能力、高性能的抖动特性和丰富的功能,在多业务网络设备和通用频率转换应用中具有广泛的应用前景。在设计过程中,工程师需要根据具体需求合理选择频率配置、外部晶体和环路滤波器电容等参数,同时熟练掌握串行控制端口的操作,以确保设备的稳定运行。你在使用AD9551或其他时钟发生器时遇到过哪些问题呢?欢迎在评论区分享交流。
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