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在通信领域,数字上变频器发挥着至关重要的作用,它能将基带信号转换为高频信号,以满足不同通信系统的需求。今天,我们就来深入探讨一款高性能的CMOS 200 MSPS 14位正交数字上变频器——AD9857。
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AD9857是一款高度集成的芯片,它将高速直接数字合成器(DDS)、高性能14位数模转换器(DAC)、时钟乘法电路、数字滤波器以及其他DSP功能集成在单一芯片上,构成了一个完整的正交数字上变频器。该芯片适用于多种通信应用,如HFC数据、电话和视频调制解调器、无线基站、宽带通信等,尤其在对成本、尺寸、功耗和动态性能有严格要求的场景中表现出色。与行业标准的AD9856相比,AD9857不仅性能得到了提升,还增加了更多实用功能。它采用节省空间的表面贴装封装,工作温度范围为 -40°C 至 +85°C,适用于各种工业环境。
它展现出了卓越的动态性能,在65 MHz(±100 kHz)AOUT时,无杂散动态范围(SFDR)可达80 dB,能有效减少信号中的杂散成分,提高信号质量。
参考时钟输入频率范围会根据参考时钟乘法器的设置而变化。当乘法器禁用时,频率范围为1 - 200 MHz;启用4×乘法时,范围为1 - 50 MHz;启用20×乘法时,范围为1 - 10 MHz。此外,输入电容为3 pF,输入阻抗为100 MΩ,占空比在不同条件下也有相应要求。
在65 MHz AOUT条件下,输入数据为2.5 MS/s、QPSK、4×过采样且逆SINC滤波器和逆CIC滤波器开启时,I/Q偏移和误差矢量幅度等指标都能达到较好的水平。
包括串行控制总线的时序特性、CMOS逻辑输入输出特性以及电源供应和功耗等方面,都有明确的规格要求,为工程师的设计提供了详细的参考。
AD9857具有三种工作模式,可通过串行端口对控制寄存器进行编程来选择。
这是默认模式,I和Q数据路径均处于激活状态。PDCLK/FUD引脚作为输出,充当并行数据时钟,用于同步数据输入。DDS核心为正交调制器提供正交(sin和cos)本地振荡器信号,I和Q数据分别与载波的相应相位相乘并求和,生成正交调制数据流,最后通过14位DAC转换为模拟输出信号。
在此模式下,I和Q数据路径从14位并行数据端口到调制器均被禁用。PDCLK/FUD引脚作为输入,充当频率更新(FUD)控制信号。DDS的余弦部分作为信号源,输出信号为单一频率,由存储在控制寄存器中的调谐字决定。
该模式下,DDS和调制器均被禁用,只有I数据路径处于激活状态。PDCLK引脚作为输出,同步数据输入。基带数据在输出端保持基带状态,通过编程插值率进行采样率转换,实现过采样操作。
在正交调制或插值DAC模式下,设备通过并行数据端口接收14位二进制补码数据。PDCLK/FUD引脚在不同模式下具有不同的功能,可方便地同步数据输入。频率控制字通过串行端口编程,FUD输入引脚用于同步频率合成器的启动。
逆CIC滤波器用于预补偿数据,抵消CIC滤波器引入的轻微衰减梯度,确保信号在基带奈奎斯特带宽内具有平坦的响应。该滤波器可通过控制寄存器进行旁路设置,以降低功耗。
固定插值器为4×插值器,由两个半带滤波器组成,可将输入数据采样率提高4倍,且插入损耗极小,相位失真可忽略不计。
可编程插值滤波器为CIC滤波器,可通过6位控制字进行2×至63×的插值设置。该滤波器具有低通频率特性,可被旁路以实现1×插值配置。
正交调制器用于将基带信号频谱上移到所需的载波频率,实现上变频。调制过程在数字域进行,可消除模拟调制器常见的相位和增益不平衡以及串扰问题。
DDS核心生成sin/cos载波参考信号,对I/Q数据路径进行数字调制。输出频率可通过32位调谐字进行精确调整,以满足不同的频率需求。
逆SINC滤波器用于补偿DAC输出信号的sin(x)/x包络,恢复所需的载波包络。该滤波器可根据需要进行旁路设置,以降低功耗。
输出比例乘法器为8位乘法器,可对输出信号进行幅度调整。用户可通过控制寄存器对其进行编程,以满足不同的输出幅度要求。
14位D/A转换器将数字处理后的波形转换为模拟信号。其输出的杂散信号主要为基波信号的谐波及其混叠成分,可通过外部RLC滤波器进行滤波。转换器的满量程输出电流可通过RSET电阻进行设置,输出负载应尽量靠近芯片封装,以减少杂散电容和电感的影响。
AD9857的串行端口是一个灵活的同步串行通信端口,与大多数同步传输格式兼容,可方便地与各种微控制器和微处理器进行接口。该接口支持单字节或多字节传输,数据格式可选择MSB先或LSB先。
指令字节包含了数据传输的相关信息,如读写操作、传输字节数和起始寄存器地址等,为数据传输提供了明确的指导。
各引脚具有不同的功能,如SCLK用于同步数据传输,CS用于芯片选择,SDIO为双向数据引脚,SDO为数据输出引脚,SYNCIO用于同步I/O端口状态机等。
控制寄存器用于配置AD9857的各种功能,包括参考时钟乘法器、PLL锁控制、工作模式选择、逆CIC滤波器旁路、频谱反转、CIC插值率和输出比例因子等。
AD9857的延迟与系统时钟(SYSCLK)周期有关,主要受可编程插值器的速率影响。在单音模式下,频率跳变的延迟较短。此外,内部时钟相位关系也会对延迟产生影响,用户在设计时需加以考虑。
通过PS0和PS1引脚可选择四种内部配置文件,每个配置文件可控制DDS输出频率、正交调制器组件的和或差、逆CIC滤波器旁路、CIC插值率和输出比例因子等参数,方便用户快速切换设备参数。
用户可通过编程调谐字为00000000h,将DDS累加器预设为0,使DDS输出sin = 0和cos = 1的信号。
芯片内置可编程时钟乘法器,可将参考时钟频率乘以4×至20×,降低了对高频参考时钟的需求,节省了成本并减少了噪声耦合问题。
PLL锁指示引脚(PLL_LOCK)可向用户提供设备是否锁定参考时钟信号的信息,用户可通过设置PLL锁控制位来控制内部设备功能。
AD9857支持单端或差分参考时钟输入,用户可根据实际需求选择合适的时钟输入方式。
CIC溢出引脚(CIC_OVRFL)可指示CIC滤波器是否发生溢出,方便用户及时发现和处理问题。
当CIC滤波器出现损坏时,用户可通过设置CIC清除位来清除滤波器,恢复正常工作。
AD9857具有数字掉电功能,可通过硬件或软件进行控制,在不传输数据时节省大量功耗,适用于突发模式应用。
全睡眠模式可通过编程控制寄存器实现,使设备的数字和模拟部分均关闭,同时保持寄存器内容不变,实现最低功耗。
AD9857的热阻为θJA = 35°C/W,在SYSCLK频率为200 MHz或更低且所有可选功能启用时,功耗可控制在允许范围内。用户可通过合理选择电源电压、时钟速度和工作模式等参数,优化设备的功耗。例如,使用TxENABLE信号在设备不调制时降低功耗。
AD9857凭借其丰富的功能、卓越的性能和灵活的配置,为通信领域的设计工程师提供了一个强大的工具。在实际应用中,工程师们需要根据具体的需求,合理选择工作模式、配置参数,充分发挥AD9857的优势,实现高效、稳定的通信系统设计。你在使用AD9857的过程中遇到过哪些问题呢?欢迎在评论区分享你的经验和见解。
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