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在高速数据传输的领域中,LVDS(低电压差分信号)技术凭借其低功耗、低噪声和高速率等优势,成为了众多应用的首选。MAX9180作为一款400Mbps的LVDS中继器,在低抖动、低噪声方面表现出色,下面我们就来详细了解一下这款产品。
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MAX9180是一款400Mbps的低电压差分信号(LVDS)中继器,它接收单路LVDS输入,并在单路LVDS输出端复制该信号。其低抖动、低噪声的性能使其非常适合缓冲在长距离或嘈杂环境(如电缆和背板)中传输的LVDS信号。
MAX9180采用SC70封装,尺寸仅为SOT23的一半。这种小尺寸使其特别适合在多点背板应用中最小化分支长度。它可以靠近连接器放置,从而减少总线上的分支长度和反射。此外,MAX9180输出与目标IC(如FPGA或ASIC)之间的点对点连接,允许目标IC与总线连接器保持更大的距离。
它具有超低的23psP - P附加确定性抖动和0.6psRMS附加随机抖动,这确保了在对时序误差高度敏感的高速链路中实现可靠通信,特别是那些包含时钟和数据恢复、PLL、串行器或解串器的链路。同时,MAX9180的开关性能保证了400Mbps的数据速率,并通过保证0.5ns的最小输出转换时间来最小化辐射噪声。
MAX9180具备故障保护电路,当输入处于未驱动的开路、短路或端接状态时,输出会被设置为高电平。
该器件采用单3.3V电源供电,在 - 40°C至 + 85°C的温度范围内仅消耗10mA电流。
MAX9180的应用十分广泛,包括但不限于以下场景:
在 (V{CC}=3.0V) 至3.6V, (R{L}=100 Omega pm 1 %) , (|V{ID}| = 0.05V) 至1.2V, (V{CM}=|V{ID} / 2|) 至2.4V - (|V{ID} / 2|) , (T_{A}=-40^{circ}C) 至 + 85°C的条件下,MAX9180具有一系列的直流电气特性,如差分输入高阈值、差分输入低阈值、输入电流、输入电阻、差分输出电压、输出高电压、输出低电压等。
在 (V{CC}=3.0V) 至3.6V, (R{L}=100 Omega pm 1 %) , (C{L}=10 pF) , (|V{ID}| = 0.15V) 至1.2V, (V{CM}=|V{ID} / 2|) 至2.4V - (|V{ID} / 2|) , (T{A}=-40^{circ}C) 至 + 85°C的条件下,其交流电气特性包括差分传播延迟、附加确定性抖动、附加随机抖动、差分器件间偏移、开关电源电流、上升时间、下降时间和输入频率等。
应使用一个0.01µF的高频表面贴装陶瓷电容尽可能靠近器件对 (V_{CC}) 进行旁路,以减少电源噪声。
输入和输出走线的特性会影响MAX9180的性能。应使用受控阻抗的差分走线,将差分对内的走线靠近以确保噪声以共模方式耦合。同时,要保持差分对内的距离,避免差分阻抗的不连续性,避免90°转弯并尽量减少过孔数量,以进一步防止阻抗不连续性。
LVDS标准定义了具有100Ω差分特性阻抗和端接的互连信号电平。允许使用特性阻抗和端接在90Ω至132Ω之间的互连,但会产生不同的信号电平。应使用具有匹配差分阻抗的电缆和连接器,以最小化阻抗不连续性。避免使用不平衡电缆,如带状电缆或同轴电缆,而应选择平衡电缆,如双绞线,以提供更好的信号质量并减少EMI。
对于点对点链路,端接电阻应位于LVDS接收器输入端,并与传输线的差分特性阻抗匹配。对于一端驱动的多点总线,应在总线的另一端使用一个与总线加载差分特性阻抗匹配的电阻进行端接。对于从非端点驱动的多点总线,应在总线的两端使用与总线加载差分特性阻抗匹配的电阻进行端接。当两端都进行端接或有大量分支时,需要一个BLVDS驱动器来将总线驱动到LVDS信号电平,而MAX9180不适合驱动双端接的多点总线到LVDS电平。
MAX9180作为一款高性能的LVDS中继器,凭借其低抖动、低噪声、小尺寸和低功耗等特性,在高速数据传输领域具有广泛的应用前景。在设计过程中,遵循上述的设计建议,可以充分发挥其性能优势,确保系统的稳定运行。各位工程师在实际应用中,不妨多考虑这款产品,看看它是否能为你的设计带来新的突破。你在使用LVDS中继器时遇到过哪些问题呢?欢迎在评论区分享你的经验。
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