可编程逻辑

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选型

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DDR2 ip核创建时，器件选型的问题

2017-09-19 3050
1 回答

Cyclone V SOC 开发套件

2017-09-19 4375
8 回答

INTEL的电源IC EM2130使用遇到问题

2017-09-19 5788
8 回答

至芯昭哥带你学FPGA_100天之旅_ram的设计

2017-09-19 4166
2 回答

关于Verilog中always块敏感信号的疑问与讨论。

2017-09-18 1w
1 回答

至芯昭哥带你学FPGA_100天之旅_rom到数码管显示

2017-09-18 2507
0 回答

急求助！！！用verilog编写一个浮点矩阵乘法器

2017-09-18 7428
1 回答

请问各位大神，做串口传输的时候，为啥第一帧数据接收正确，接着第二针之后就数据错误是什么问题啊

2017-09-18 4012
3 回答

Altium-Designer

2017-09-17 4540
12 回答

FPGA电子综合设计实践

2017-09-17 4914
22 回答

使用QUARTUS_II做FPGA开发全流程,傻瓜式详细教程

2017-09-17 7739
32 回答

【AC620 FPGA试用体验】+以太网传图帧缓存系统设计附工程源码（结项）

2017-09-17 1.4w
4 回答

至芯昭哥带你学FPGA之FPGA_100天之旅_数码管设计

2017-09-17 3126
3 回答

编译出错，找不到模块inst1

2017-09-17 2298
1 回答

【小白入门笔记】小脚丫实现38译码器——模块建模和门级建模初探

2017-09-16 7642
0 回答

Vivado2015.4 srio gen2 V4.0的lic激活文件

2017-09-16 6531
2 回答

fpga连步进电机驱动后电机转时影响fpga信号

2017-09-15 3593
1 回答

【锆石A4 FPGA试用体验】由组合逻辑开始学习FPGA编程

2017-09-15 4039
0 回答

控制ad5331进行数模转换的Verilog问题

2017-09-15 4372
1 回答

最新镁光内存，最近货期这么长，这么缺，你还不知道

2017-09-14 4703

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