Function | Dual-loop PLL |
Number of outputs | 10 |
RMS jitter (fs) | 65 |
Output frequency (Min) (MHz) | 0.03 |
Output frequency (Max) (MHz) | 2000 |
Input type | LVCMOS, LVDS, LVPECL |
Output type | LVDS, LVPECL |
Supply voltage (Min) (V) | 1.7 |
Supply voltage (Max) (V) | 3.465 |
Features | JESD204B |
Operating temperature range (C) | -40 to 85 |
- 双环路 PLL 架构
- 超低噪声(10kHz 至 20MHz):
- 1966.08MHz 频率下 48fs RMS 抖动
- 983.04MHz 频率下 50fs RMS 抖动
- 122.88MHz 频率下 61fs RMS 抖动
- 122.88MHz 时具有 –165dBc/Hz 本底噪声
- JESD204B 支持
- 一次性、脉冲和连续 SYSREF
- 10 个差动输出时钟(处于 8 个频率组中)
- 介于 700mVpp 和 1600mVpp 之间的可编程输出摆幅
- 每个输出对可配置为 SYSREF 时钟输出
- 16 位通道分频器
- 最小 SYSREF 频率为 25kHz
- 最大输出频率为 2GHz
- 精密数字延迟,动态可调
- 数字延迟 (DDLY) ? × 时钟分配路径频率(最大 2GHz)
- 60ps 步长模拟延迟
- 50% 占空比输出分配,1 至 65535
(偶数和奇数)
- 2 个基准输入
- 输入丢失时采用保持模式
- 自动和手动切换模式
- 信号损失 (LOS) 检测
- 在 10 个有源输出下的典型功耗为 0.88W
- 通常由 1.8V(输出、输入)和 3.3V 电源(数字、PLL1、PLL2_OSC、PLL2 内核)供电
- 完全集成的可编程环路滤波器
- PLL2
- PLL2 相位检测器频率高达 250MHz
- OSCin 倍频器
- 集成式低噪声 VCO
- 内部功率调节:优于 –80dBc PSRR(在 VDDO 上)(对于 122.88MHz 差动输出)
- 3 线制或 4 线制 SPI 接口(4 线制为默认设置)
- –40oC 至 +85oC 工业环境温度
- 支持 105oC PCB 温度(在散热焊盘上测量)
- LMK04610:8mm × 8mm VQFN-56 封装,间距为 0.5mm
LMK0461x 器件系列具有业界性能最高且功耗最低的抖动清除器,支持 JESD204B 接口。