专题74ls73是什么

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74LS73双负边缘触发主从机输出清晰互补的J-K触发器的数据手册

该器件包含两个独立的负边缘触发J-K触发器，具有互补输出。J和K数据由时钟脉冲下降沿上的触发器处理。时钟触发发生在电压水平，并且与时钟脉冲的负向边缘的过渡时间没有直接关系。只要不违反设置和保持时间，J和K输入上的数据允许在时钟高或低时改变，而不影响输出。清除输入上的低逻辑电平将重置输出，而不考虑其他输入的电平。

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74LS73A英文手册

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HD74LS73A pdf

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74ls00

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74LS73A pdf datasheet

DM54LS73A/DM74LS73A Dual Negative-Edge-TriggeredMaster-Slave J-K Flip-Flops with Clearand Complementary OutputsGeneral DescriptionThis device contains two independent negative-edge

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