orcad port bus
在 OrCAD Capture 中,Port Bus(总线端口)是用于在层次化设计中连接总线信号的专用端口。与普通端口(Port)不同,它专门处理一组信号(总线),简化多信号跨原理图页的连接。以下是关键要点和操作步骤:
核心概念
-
作用
- 在顶层原理图与子图之间传递总线信号(如
Data[0..7],Address[15:0])。 - 替代多个单线端口,保持设计整洁。
- 在顶层原理图与子图之间传递总线信号(如
-
命名规则
- 名称需与总线名称完全一致(区分大小写)。
- 示例:若总线名为
DATA_BUS[0:7],则总线端口名应为DATA_BUS(无需范围)。
-
类型选择
PORTBOTH(双向)PORTLEFT/PORTRIGHT(输入/输出方向,影响符号外观)
创建步骤
-
放置总线端口
- 菜单:Place → Hierarchical Port
- 快捷键:Ctrl + H
-
选择端口类型
- 在属性窗口中选择
PORTBOTH(或PORTLEFT/PORTRIGHT)。
- 在属性窗口中选择
-
命名端口
- 名称与总线名一致(不含范围):
- 总线:
ADDR[15:0]→ 端口名:ADDR
- 总线:
- 名称与总线名一致(不含范围):
-
连接总线
- 将端口直接连接到总线(Bus)上,确保电气连通。
注意事项
- 范围匹配:子图中的总线宽度(如
[0:7])必须与顶层端口连接的总线一致。 - 端口类型:
PORTBOTH最常用,不影响电气特性,仅改变符号方向。 - 命名一致性:端口名错误会导致 Netlist 错误(如 "Unresolved net")。
- 跨页连接:需在顶层原理图中通过总线入口(Bus Entry) 将端口连接到其他模块。
常见错误
- 端口名带范围:命名端口为
DATA[0:7](正确应为DATA)。 - 未直连总线:端口未通过总线与内部信号连接。
- 层次不匹配:子图总线宽度与顶层连接的总线宽度不一致。
操作示例
- 在子图放置
PORTBOTH端口,命名为CONTROL。 - 将
CONTROL端口连接到子图总线CONTROL[3:0]。 - 在顶层原理图中,该端口会自动关联到同名总线
CONTROL[3:0]。
正确使用总线端口可显著提升多页设计的可读性和可靠性!遇到问题可检查 Netlist 报告 或 DRC 错误 定位连接问题。
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