ad中pcb差分走线联不上
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在 Altium Designer (AD) 中遇到差分对走线无法连接的问题,通常由以下几个原因引起。请按照以下步骤逐一排查:
-
差分对未正确定义或未正确导入到 PCB:
- 原理图检查: 确保在原理图中,构成差分对的两个网络(如
USB_DP和USB_DN) 被正确标记为一对。最常见的方法是使用后缀_P和_N(或+和-),如USB_DP和USB_DN。Altium 通常会自动识别这种命名规则作为差分对。 - PCB 同步: 确保已将原理图更改同步到 PCB 项目(使用
设计 (Design) > 更新PCB文档 (Update PCB Document...))。同步后,差分对应该出现在 PCB 的差分对编辑器中。 - PCB 差分对编辑器检查 (
设计 (Design) > 差分对编辑器 (Differential Pair Editor)): 打开差分对编辑器,确认你的差分对是否已列出并且处于已定义 (Defined)状态。如果这里没有你的差分对,说明定义或导入有问题。
- 原理图检查: 确保在原理图中,构成差分对的两个网络(如
-
差分对布线规则未设置或设置不当:
- 打开规则管理器 (
设计(Design) > 规则(Rules)): 这是最常见的问题所在。 - 查找差分对规则: 在规则管理器左边的树状结构中,展开
Routing,然后展开Differential Pairs Routing。 - 检查规则存在性与范围:
- 必须有规则存在! 如果在
Differential Pairs Routing下没有任何规则(或者有规则但范围不匹配),AD 不知道如何以差分方式布线。 - 规则范围: 双击现有的差分对规则(或创建新规则)。在
第一个对象匹配哪里 (Where The First Object Matches)部分,范围应设置为所有差分对 (All Differential Pairs)或者你的 特定差分对类 (如果你创建了类)。确保规则适用于你的目标差分对。
- 必须有规则存在! 如果在
- 检查规则约束: 在规则约束 (
Constraints) 选项卡中,检查:- 差分对间隙 (Differential Pair Gap): 设置允许的最小 (
Min) 和首选 (Preferred) 两根差分线中心到中心的间距。这个值必须大于等于你的线宽,否则物理上无法布线(两根线会重叠)。通常设置为线宽的2倍左右。 - 最大间隙 (Max Gap): 设置两根线间距允许的最大偏差。如果实际布线时两根线间距超过了此值,AD 会阻止连接或报错。
- 目标线宽 (Target Width): 设置差分对中单根线的宽度(
Min/Preferred/Max)。确保这里设置的宽度在Width规则中是允许的。 - 公差 (Tolerance): 确保设置合理(通常默认即可)。
- 差分对间隙 (Differential Pair Gap): 设置允许的最小 (
- 规则优先级: 如果有多个规则,确保针对你的差分对的规则具有足够高的优先级。
- 检查一般走线宽度规则 (
Routing > Width): 差分对规则中的Target Width必须在Width规则为该网络定义的合法范围内。差分对规则会覆盖Width规则,但Width规则定义了可用宽度的边界。确保Width规则的范围也包含了你的差分对网络(例如InNet('USB_DP') or InNet('USB_DN'))。
- 打开规则管理器 (
-
物理连接受阻或焊盘/过孔出口问题:
- 空间不足: 焊盘间距可能太小,无法以你设定的差分间隙和线宽同时引出两根线。尝试:
- 减小差分对规则中的
Preferred Gap(但确保满足阻抗要求)。 - 减小差分对规则中的
Preferred Width(但确保满足阻抗要求)。 - 检查焊盘出口方向是否允许差分线并行引出。可能需要调整焊盘形状或使用更小的过孔。
- 减小差分对规则中的
- 障碍物阻挡: 焊盘附近有其他元件、走线、禁止布线区 (
Keep-Out)、铜皮等,导致没有足够空间按规则走线。尝试临时移动或删除障碍物测试。 - 焊盘/过孔连接问题: 有时软件在从非常密集的焊盘(尤其是BGA)引出差分线时可能有困难。尝试:
- 手动先分别布其中一根线一小段(
P或N),离开拥挤区域后再切换到差分对布线模式 (放置(Place) > 差分对布线(Differential Pair Routing)或快捷键P+I) 连接剩下的部分。 - 在规则管理器的
Routing > Differential Pairs Routing > Differential Pair Style规则中(如果没有则新建),尝试切换Optimization Effort(优化力度) 为Medium或High。 - 确认焊盘的层连接设置正确。
- 手动先分别布其中一根线一小段(
- 空间不足: 焊盘间距可能太小,无法以你设定的差分间隙和线宽同时引出两根线。尝试:
-
软件或视图问题:
- 重启 AD: 有时临时性软件故障会导致奇怪行为,重启试试。
- 检查可见性: 确认所有相关层(丝印层、走线层、禁止布线层等)都是可见的 (
视图(View) > 显示/隐藏(Show/Hide)或快捷键L)。 - 更新到最新版本: 旧版本可能存在已知 Bug。
- 错误提示: 注意 AD 在尝试布线时左下角状态栏或弹出的错误提示信息,这些信息往往直接指出了失败的原因(如
Clearance Constraint,Differential Pair Constraint等)。
排查步骤总结:
- 确认原理图和 PCB 中差分对已正确定义并同步。
- 重点检查规则管理器 (
Design > Rules):- 确保
Differential Pairs Routing下有规则存在。 - 确保规则范围 (
Where The First Object Matches) 匹配你的差分对(通常是All Differential Pairs)。 - 仔细检查规则约束 (
Constraints),特别是Min Gap,Preferred Gap,Max Gap,Target Width。确保设定的Preferred Gap大于等于Target Width(物理上两根线不能重叠)。 - 检查
Routing > Width规则是否允许差分对规则设定的线宽。
- 确保
- 检查 PCB 上物理空间是否足够,有无障碍物阻挡,焊盘出口是否合理。
- 尝试手动单根布线一小段再切换差分模式。
- 查看软件错误提示。
- 重启软件或更新版本。
通过系统地检查以上方面,通常就能找到并解决差分对无法连接的问题。规则设置不当(尤其是间隙 Gap 和线宽 Width 的关系)是最常见的原因。
PCB设计布线的走线有哪些策略详细资料说明
是至关重要的。下面将针对实际布线中可能遇到的一些情况,分析其合理性,并给出一些比较优化的走线策略。主要从直角走线,
资料下载
ah此生不换
2019-07-19 16:47:50
关于PCB差分走线的五个常见误区
过孔造成的反射,这对信号传输不会造成明显的影响。 而线长一旦不匹配,除了时序上会发生偏移,还给差分信号中引入了共模的成分,降低信号的质量,增加
2023-04-12 15:15:48
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