pcb 内层 爬电距离
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在PCB设计中,内层爬电距离需根据安全标准(如IEC 60950、IEC 60664)和实际应用电压确定。以下是关键要点:
1. 内层爬电距离的特殊性
- 无沿面路径:内层走线被树脂完全包裹,爬电路径被阻断。
- 主要考量电气间隙:内层主要关注 导体间最短直线距离(即电气间隙,Clearance),而非爬电距离(Creepage)。
- 例外情况:若内层有开窗(如盲槽、开孔)或层压缺陷导致爬电风险,需按外层标准处理。
2. 设计依据
- 电压等级:根据工作电压(或峰值电压)查表确定最小间距(IEC 60664-1)。
- 污染等级:内层通常视为 污染等级1(密封洁净环境),允许更小间距。
- 绝缘材料:FR-4的CTI(Comparative Tracking Index)一般≥600V,属 材料组别I。
3. 内层最小间距参考
| 电压 (V) | 最小电气间隙 (mm) | 爬电距离 (mm) |
|---|---|---|
| ≤50 | 0.1 | 0.1(理论值) |
| 100 | 0.2 | 0.2 |
| 300 | 1.0 | 1.5 |
| 600 | 2.0 | 3.0 |
注:实际值需结合标准图表或工具计算(如IPC-2221B)。
4. 关键注意事项
- 高压设计:≥300V时需严格检查内层间距,避免局部放电。
- 层压质量:确保无分层或空洞,防止潜在爬电路径。
- 开窗区域:内层铜箔暴露处(如激光盲孔),需按外层要求增加爬电距离。
- 安全认证:医疗/工业设备需遵循IEC 62368等专项标准。
5. 设计建议
- 优先满足 电气间隙 要求(内层爬电距离通常等于间隙)。
- 高压走线间添加 绝缘槽(Slot)或 隔离带。
- 使用 IPC-2221B计算工具 或 Altium/Cadence DRC规则 自动化校验。
总结:PCB内层爬电距离实际由 电气间隙主导,标准值与电压正相关。设计时应以电气间隙为基础,仅在特殊开窗结构时单独核算爬电距离。务必通过 介电强度测试 和 Hi-Pot测试 验证绝缘可靠性。
PS9924 数据表(长爬电距离,15mm,8 针 LSDIP 光电耦合器)
PS9924 数据表(长爬电距离,15mm,8 针 LSDIP 光电耦合器)
资料下载
李微波
2023-02-02 18:41:29
医疗应用的爬电距离要求
增强型隔离器组件的常见封装是 JEDEC 标准 SOIC16-W,宽 7.4 毫米,宽 2 毫米 厚。沿此封装表面的最短路径为 通常在末端,通常只有7.6毫米。这 比人们预期的要短,因为类似 对于大多数引线设备,它包括沿 爬电
2023-04-04 11:24:20
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