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如何使用FPGA进行幅值可调信号发生器的设计

消耗积分:0 | 格式:rar | 大小:0.49 MB | 2018-11-06

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  针对信号发生器对输出频率精度高和幅值可调的要求,采用直接数字频率合成(DDS)技术,提出一种基于FPGA的幅值、频率均可调的、高分辨率、高稳定度的信号发生器设计方案。采用AT89S52单片机为控制器,控制FPGA产生波形的数字信号,结合双数模(D/A)转换器及低通滤波器,最终实现输出信号幅值O一5 V可调。分辨率为l0bits;频率范围l Hz~10 MHz可调,最小分辩率为1 Hz;频率稳定度优于104。信号参数可通过键盘进行设置,并在LCD上输出。由于FPGA的可编程性。易于对系统进行升级和优化。

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