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可编程逻辑
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关于FPGA时序工具的一些FAE解答
2021-10-12
3903
1
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莱迪思ICE40LP1K-CM36芯片问题
2021-10-08
4626
1
回答
怎么实现FPGA与无线模块（RM04）连接起来
2021-10-08
4616
2
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状态机设计问题
2021-10-06
4833
2
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请问怎么用verilog来描述一个8位数据选择器呀
2021-10-01
9451
1
回答
【萌新求助：无法绑定引脚】vivado绑定引脚时，选项中缺少原理图上的引脚，无法选择和绑定，编辑constr文件也会报错。
2021-09-27
8623
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FPGA 高级设计：时序分析和收敛
2021-09-27
2795
0
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关于modelsim后仿真锁存器出现不定态的问题
2021-09-26
5892
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回答
一种基于FPGA的图神经网络加速器解决方案
2021-09-25
3972
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AGM FPGA调试建议
2021-09-23
3649
4
回答
FPGA testbench指南
2021-09-23
3963
0
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FPGA设计中,使用ISE和Matlab创建并仿真ROM IP核
2021-09-22
2884
1
回答
在使用quartus调用modelsim时发生错误
2021-09-17
4686
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回答
当AI遇上FPGA会产生怎样的反应
2021-09-17
3756
0
回答
如何有效地开展FPGA/SoC架构设计工作？
2021-09-15
3359
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回答
AD9361 BIST功能验证相关事项
2021-09-14
7409
0
回答
简谈数字电路设计中的抖动
2021-09-13
2416
1
回答
ADATE320 SPI通信不了
2021-09-13
3825
3
回答
新手求助FPGA画板bank电压问题？
2021-09-10
8430
1
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FPGA
2021-09-10
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