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数字逻辑
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数字逻辑（数字逻辑：基于二进制数学或布尔代数的逻辑）数字逻辑，是处理数字信号的逻辑，数字电路运作的原理;实质上是指基于二进制数学或布尔代数的逻辑。
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[8.2.1]--锁存器和触发器
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[8.1.1]--8.1时序逻辑电路的标准文档
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[7.14.1]--7.14状态机时序
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[7.13.1]--7.13雷鸟车尾灯
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[7.12.1]--7.12时钟同步状态机设计2
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[7.11.1]--7.11时钟同步状态机设计1
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[7.10.1]--7.10时钟同步状态机分析2
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[7.9.1]--7.9时钟同步状态机分析
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[7.7.1]--7.7JK触发器和T触发器
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[7.6.1]--7.6其他D触发器
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[7.5.1]--7.5D触发器
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[7.4.1]--7.4D锁存器_clip002
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[7.4.1]--7.4D锁存器_clip001
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[7.3.2]--7.3.2SR锁存器的描述
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[7.3.1]--7.3.1SR锁存器工作原理
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[7.2.1]--7.2双稳态器件
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[7.1.1]--7.1时序逻辑电路概述
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[6.8.1]--6.3编码器
李开鸿
198
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[6.7.1]--加法器
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![[8.2.1]--锁存器和触发器](https://file1.elecfans.com/web2/M00/85/A0/wKgaomRmN5KAVRsLAAAh38peapw583.png)
李开鸿 ![[7.14.1]--7.14状态机时序](https://file1.elecfans.com/web2/M00/85/A0/wKgaomRmN5KAdJ5GAAAnMe_NGuM138.png)
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![[7.4.1]--7.4D锁存器_clip002](https://file1.elecfans.com/web2/M00/85/A1/wKgZomRmN5GAFkvMAABX0zc6zNA659.png)
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![[7.3.2]--7.3.2SR锁存器的描述](https://file1.elecfans.com/web2/M00/85/A0/wKgaomRmN5CAVv2cAAAiJgguLfo084.png)
![[7.1.1]--7.1时序逻辑电路概述](https://file1.elecfans.com/web2/M00/85/A0/wKgaomRmN5CAI1-VAAAh_S297BE727.png)
![[6.8.1]--6.3编码器](https://file1.elecfans.com/web2/M00/85/A1/wKgZomRmN46AL2KuAAAeJQq7ACI845.png)