candence添加pcb封装
在 Cadence Allegro/OrCAD 中添加 PCB 封装(Footprint)主要涉及两个关键环节,具体取决于你当前的操作阶段:
核心环节一:将封装关联到原理图符号 (通常在 OrCAD Capture CIS 中完成)
这是最重要的一步,确保原理图设计时选择的元器件知道它对应的物理封装是什么。
- 打开原理图库或设计:
- 打开包含目标元器件的原理图库 (
.olb文件) 或打开你的设计项目 (.dsn文件)。
- 打开包含目标元器件的原理图库 (
- 找到并编辑元器件属性:
- 库中编辑: 在库管理器中找到需要添加或修改封装的元器件符号,双击它打开属性对话框 (或右键 ->
Edit Part)。 - 设计中编辑: 在设计页面上,双击元器件本身打开属性对话框 (或选中元器件,右键 ->
Edit Part)。更常见的是在项目管理器中的设计文件 (<design name>.dsn) 下,展开Design Cache,找到该元器件,右键选择Edit Part进行全局修改。
- 库中编辑: 在库管理器中找到需要添加或修改封装的元器件符号,双击它打开属性对话框 (或右键 ->
- 添加/修改 PCB Footprint 属性:
- 在打开的元器件属性对话框 (通常叫
User Properties或Part Properties) 中,找到名为PCB Footprint的属性行。 - 如果已有属性: 直接修改
Value列下的封装名称为你需要的正确封装名 (如RES_0805,SOIC-8_3.9x4.9mm_P1.27mm)。 - 如果没有属性: 点击
New...(或Add...) 按钮,在Name栏输入PCB Footprint(注意大小写和空格需与标准一致,通常是PCB Footprint),在Value栏输入正确的封装名称。
- 在打开的元器件属性对话框 (通常叫
- 保存修改:
- 库中编辑: 保存库文件 (
.olb)。 - 设计中编辑 (
Design Cache修改): 保存设计文件 (.dsn)。如果是从Design Cache修改的,系统通常会提示是只更新缓存还是更新源库,根据需要选择。为了设计一致性,通常建议更新源库(如果该符号是可编辑的库中的)。
- 库中编辑: 保存库文件 (
核心环节二:确保封装库路径正确设置 (在 Allegro PCB Editor 中完成)
这是确保 Allegro 在导入网表或放置元器件时能找到封装物理文件的关键。
- 启动 Allegro PCB Editor: 打开你的 PCB 设计文件 (
.brd)。 - 打开 Setup 菜单: 点击顶部菜单栏的
Setup。 - 打开 User Preferences: 选择
User Preferences...。 - 定位到库路径设置:
- 在左侧目录树中,展开
Paths->Library。 - 需要配置的关键路径有:
padpath: 最重要! 指定 PCB 封装所用焊盘 (.pad) 文件的搜索路径。可以添加多个路径。Allegro 会按顺序搜索。psmpath: 指定 PCB 封装符号 (.dra, 有时也指.psm) 文件的搜索路径。可以添加多个路径。devpath: (可选) 指定器件文件 (.dev) 的路径(主要用于老版本或特定约束)。modulepath: (可选) 指定模块 (.mdd) 的路径。
- 在左侧目录树中,展开
- 添加/修改路径:
- 选中你想要设置的路径类型 (如
padpath)。 - 在右侧
Library Path区域,你会看到当前设置的路径列表。 - 添加路径: 点击路径列表下方的
Add按钮,浏览找到你的焊盘库或封装库所在的文件夹,选择文件夹后点击确定/OK。 - 移除路径: 选中一个路径,点击
Delete按钮移除。 - 调整顺序: 使用
Up和Down按钮调整路径的搜索优先级。Allegro 会从列表顶部开始搜索。
- 选中你想要设置的路径类型 (如
- 应用并确认:
- 点击
OK或Apply按钮保存路径设置。 - 一般建议重启 Allegro 以使新的路径设置完全生效(特别是当封装找不到时,重启是常用解决步骤)。
- 点击
后续操作和验证
- 生成/导入网表: 在 OrCAD Capture 中完成原理图设计并正确关联封装后,需要生成网表 (Netlist)。通常选择
Allegro/OrCAD PCB Designer格式。 - 导入网表到 Allegro: 在 Allegro PCB Editor 中,使用
File->Import->Logic...导入生成的网表文件 (通常是pstxnet.dat,pstxprt.dat等)。Allegro 会根据padpath和psmpath的设置查找并加载封装。 - 放置元器件: 成功导入网表后,元器件就应该出现在
Placement列表中。使用Place->Manually开始放置,Allegro 会从库路径中调用封装图形。 - 验证封装是否存在: 在 Allegro 中,可以使用
Place->Manually,在Advanced Settings选项卡勾选Library,然后在Placement List选项卡下拉框选择Package symbols,输入部分封装名查找。如果能找到并预览图形,说明路径设置和封装文件本身基本正确。
常见问题和注意事项
- 封装名严格一致:
PCB Footprint属性值必须与封装物理文件.psm(或.dra) 的文件名完全一致(不包括扩展名),大小写也要匹配(Linux环境下通常区分大小写)。 - 焊盘路径 (
padpath) 必须正确: 这是报错最多的环节!封装 (.psm) 依赖于焊盘 (.pad)。如果padpath没设或路径错误,即使封装路径 (psmpath) 正确,Allegro 也无法加载封装,会报找不到焊盘或封装无效的错误。 - 路径搜索顺序: 如果一个封装名存在于多个
psmpath路径下,Allegro 会使用它在搜索顺序中找到的第一个。确保优先级高的路径放前面。 - 封装文件本身是否存在: 确保你输入的
PCB Footprint名称对应的.psm(或.dra) 文件确实存在于你设置的psmpath下的某个路径中。 - 文件权限: 确保运行 Allegro 的用户有权限读取库路径下的文件。
- 环境变量: 虽然
User Preferences是首选方法,但旧版或某些配置也可能依赖操作系统环境变量 (如CDS_SITE,$HOME/pcbenv下的allegro.ilinit或env文件),但现代实践推荐在User Preferences中设置。 - 重启 Allegro: 修改库路径 (
User Preferences) 后,有时需要重启 Allegro 才能完全生效,特别是遇到找不到封装的问题时。
总结流程:
- 原理图端 (OrCAD Capture): 给元器件符号的
PCB Footprint属性赋值(正确的封装名)。 - PCB端 (Allegro): 在
User Preferences(Paths->Library) 中正确设置padpath(焊盘路径) 和psmpath(封装路径)。 - 传递设计: 从 Capture 生成网表,在 Allegro 中导入网表。
- 放置验证: 在 Allegro 中放置元器件,确认封装正确加载。
按照以上步骤仔细检查和操作,通常就能成功地在 Cadence 设计流程中添加和使用 PCB 封装。如果在导入网表或放置时遇到封装找不到的错误,重点检查 padpath 和封装名称的拼写/大小写。
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