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基于FPGA的16位乘法器的实现
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2021-06-01
姚小熊27
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本设计以16位乘法器的设计为基础，从而掌握现代大规模集成数字逻辑电路的应用设计方法，进一步掌握电子仪器的正确使用方法，以及掌握利用计算机进行电子设计自动化（EDA）的基本方法。由16位加法器构成的以时序逻辑方式设计的16位乘法器，乘法通过逐向移位加原理来实现，从被乘数的最低位开始，若为1，则乘数左移与上一次和相加；若为0，左移后以全零相加，直至被乘数的最高位。从而实现乘法的移位运算。
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