关于FPGA设计的一些事
大多数 FPGA 设计需要人员 多次 进出实验室的来回 调试 修改
超过 85% 的 FPGA 设计有多个时钟域
在超过 85% 的 FPGA 中发现在前端工作中就可能可以清除的BUG , 但是 BUG 却流入了后段生产47% 的设计需遵守特定的设计安全标准63% 通过仿真被找出的问题 , 可以在编写代码的时候就发现在 Blue Pearl 的客户群体当中 , 有 83% 的用户是 FPGA 的使用者 。这些用户在搭配使用 Blue Pearl 软件之后都明确达到了改善QoR 节省大量时间金钱 , 取得了高回报
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