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板级互连线的串扰规律研究与仿真
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2011-06-22
scu8848
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串扰是高速电路板设计中干扰信号完整性的主要噪声之一；为有效地抑制串扰噪声，保证系统设计的功能正确，有必要分析串扰问题。针对实际ＰＣＢ中互连线拓扑和串扰的特点，构建三线耦合均匀传输线模型，采用信号完整性仿真工具ＨｙｐｅｒＬｙｎｘ进行ＰＣＢ布线前的ＬｉｎｅＳｉｍ 串扰仿真，详细分析了高速ＰＣＢ 中多种因素：耦合长度、耦合间距、信号上升时间、介质厚度、端接等对近端和远端串扰宽度和幅值的影响；最后总结了串扰宽度及其幅值的变化规律，可有效的指导ＰＣＢ设计中减小串扰噪声。
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