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一种高速流水线乘法器结构
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2018-03-15
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设计了一种新颖的32×32位高速流水线乘法器结构．该结构所采用的新型Radix-16 Booth算法吸取了冗余Booth编码与改进Booth编码的优点，能简单、快速地产生复杂倍数．设计完成的乘法器只产生9个部分积，有效降低了部分积压缩阵列的规模与延时．通过对5级流水线关键路径中压缩阵列和64位超前进位（CLA）加法器的优化设计，减少了乘法器的延时和面积．经现场可编程逻辑器件仿真验证表明，与采用Radix-8 Booth算法的乘法器相比，该乘法器速度提高了11%，硬件资源减少了3%．
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