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AG10K FPGA调试的建议

消耗积分:1 | 格式:pdf | 大小:0.77 MB | 2022-08-23

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AGM FPGA 在配置成功时，PLL 已经完成锁定，lock 信号已经变高；如果原设计中用 lock 信 号输出实现系统 reset 的复位功能，就不能正确完成上电复位；同时，为了保证 PLL 相移的 稳定，我们需要在 PLL 启动后做个延时的复位，设计中可以参考下面 Verilog 代码，这里需 要 PLL 的 areset 或 pfdena 引出，通过复位信号控制。
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