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如何在SoC中实现低功耗RF的设计
百灵千岛酱
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在芬兰举行的国际SoC会议上，Catena Radio Design公司的CTO Kianush做了主题演讲：SoC中低功耗RF收发器的设计策略，它涉及到当前的一个问题即高度集成对数字电路来讲很有利，但是对RF设计者来讲却是个头疼的问题，主要问题包括串扰（数字噪声引入电源和信号线），无法接受的电源特性以及成本问题。 Kianush在演讲中提到的最大挑战是射频共存（比如GPS， 蓝牙和蜂窝通信）的问题。当想要更多的集成多个收发器在一个die中来降低成本时，将所有的射频部分完美地放在一起会由于接口问题而变成一个大难题。另外，在大小适当的晶片上实现这样的射频设计也是个问题，因为Vdd总是与更小器件尺寸匹配，所以太低的Vdd会降低射频的信号处理能力，引起更多的泄漏（因为更薄的氧化层），增加1/f闪烁噪声。器件尺寸的缩放对RF收发器的功率耗散并没有帮助，因为发送器的功率由政府法规确定，它并不像数字电路一样功耗完全由技术决定。 SoC中的RF收发器包含了模拟、RF、混合信号以及DSP电路。这是个很难做的混合物，所以现在有趋势将收发器做的尽量数字化，这个趋势就是软件无线电（SDR），它看上去是RF领域在这个年代的圣杯。通过校准和纠正技术，一个更加数字化的收发器可以用DSP来补偿低成本的模拟电路所带来的影响。
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