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基于NiosII处理器的SVPWM IP Core设计

消耗积分:0 | 格式:pdf | 大小:593 KB | 2011-12-23

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利用Verilog HDL实现了算法的硬件设计,并封装成IP核以方便设计复用,在Altera公司的DE2开发板上进行了设计验证,体现了SOPC嵌入式系统的灵活性和扩展性。

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