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MPEG24视频变长码并行解码器硬件实现

消耗积分:0 | 格式:pdf | 大小:343 KB | 2011-05-13

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提出了一个MPEG24 变长码并行解码器的硬件设计. 采用桶形移位器、基于PLA 的并行解码算法等方法使得每个时钟周期解一个变长码码字. 通过将码表改造、分割长码表为几个短码表并行查表、使用流水线技术等措施减少关键路径的延时以提高工作频率,保证了MPEG24 ASPL5 格式码流的实时解码.
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