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基于VHDL的电表抄表器设计

消耗积分:0 | 格式:pdf | 大小:237 KB | 2011-09-23

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文章在MAX+PLUS II 开发环境下采用VHDL 语言设计并实现了电表抄表器讨论了系统的四个组成模块的设计和VHDL 的实现每个模块采用RTL 级描述整体的生成采用图形输入法通过波形仿真下载芯片测试完成了抄表器的功能
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