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基于ASIC/SoC的UART核的设计

消耗积分:5 | 格式:rar | 大小:225 | 2010-06-19

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基于ASIC/SoC的UART核的设计

摘要：本文描述了通用异步收发机UART（Universal Asynchronous Receive Transmitter）
核的一种优化设计实现的设计流程。通过采用划分功能模块使结构直观清晰并且简化了设计流程。该UART 核采用VerilogHDL 语言描述其功能，对RTL 级实现优化，解决了多时钟、亚稳态和毛刺等问题。用SYNOPSYS 软件仿真、验证和综合、优化生成的IP(Intellectual Property)核可以很方便地嵌入到ASIC/SoC 设计中。
关键词：UART，SoC，VerilogHDL 语言，验证与综合

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