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用于Xilinx 7系列GTZ收发器的IBERT的详细数据和资料说明
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2019-02-21
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7系列FPGA GTZ收发器的可定制的Logicore™IP Chipscope™Pro集成误码率测试（IBert）内核用于评估和监控GTZ收发器。该核心包括在FPGA逻辑中实现的模式生成器和校验器，以及对端口的访问和GTZ收发器的动态重新配置端口属性。还包括通信逻辑，允许通过JTAG对设计进行运行时访问。根据客户配置和本文档中的描述，此核心可以用作独立的或开放的设计。
Ibert核心设计用于需要验证或评估7系列FPGA GTZ收发器的任何应用。
Ibert核心为7系列FPGA GTZ收发器提供了一个广泛的物理介质附件（PMA）评估和演示系列。可以参数化地使用不同的GTZ收发器和时钟拓扑结构，也可以自定义ibret核心，以使用不同的线路速率、参考时钟速率和逻辑宽度。每个所需的GTZ收发器都包含数据模式生成器和校验器，提供了许多不同的伪随机二进制序列（PRB）和要通过通道发送的时钟模式。此外，可以通过与GTZ收发器的DRP端口通信的逻辑访问GTZ收发器的配置和调整，以更改属性设置，以及控制端口上的值的寄存器。在运行时，Chipscope Analyzer工具通过JTAG，使用作为Ibert核心一部分的xilinx电缆和专有逻辑与Ibert核心进行通信。
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