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基于DSP和CPLD电能质量监测装置的设计

消耗积分:5 | 格式:rar | 大小:524 | 2010-08-26

郑成枝

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设计了一种基于DSP+CPLD构架的电能质量监测装置，该装置利用CPLD产生DSP外围器件的控制时序，丈中详细介绍
了CPLD对DSP外围器件的逻辑接口设计，通过MAX+PLUSII对CPLD的控制时序进行仿真，仿真结果验证了本设计的可行性，
试验测试结果表明该装置实现了多项电能质量指标的实时在线监测．
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