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使用加密和身份验证来保护UltraScale/UltraScale+ FPGA比特流

消耗积分:0 | 格式:pdf | 大小:0.82 MB | 2023-09-13

王萍

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本应用笔记介绍了使用 Xilinx®Vivado® 设计套件生成加密比特流和加密密钥（AES-GCM 和 RSA 身份验证）的简单分步过程。还包括使用 VivadoDesign Suite 将 AES-GSM 加密密钥和 RSA 公钥哈希以及加密比特流编程到 Xilinx UltraScale™ FPGA 的步骤。本应用笔记适用于UltraScale和UltraScale+ ™ FPGA。
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