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基于FPGA的时钟跟踪环路的设计

消耗积分:0 | 格式:pdf | 大小:222.03KB | 2023-11-01

刘桂英

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简介:提出了一种基于FPGA的时钟跟踪环路的设计方案,该方案简化了时钟跟踪环路的结构,降低了时钟调整电路的复杂度。实际电路测试结果表明,该方案能够使接收机时钟快速准确地跟踪发射机时钟的变化,且时钟抖动小、稳准度高、工作稳定可靠。

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