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基于FPGA的SDX总线与Wishbone总线接口设计

消耗积分:0 | 格式:pdf | 大小:681 KB | 2012-01-11

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介绍了基于硬件描述语言Verilog HDL设计的SDX总线与Wishbone总线接口转化的设计与实现,并通过Modelsim进行功能仿真,在QuartusⅡ软件平台上综合,最终在Altera公司的CycloneⅢ系列FPGA上调试。实验证明了设计的可行性。

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