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FPGA入门系列实验教程之实现数码管静态显示的详细资料说明

消耗积分:0 | 格式:rar | 大小:0.41 MB | 2019-06-12

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　　1. 实 验 任 务

　　实现开发板上的数码管静态循环显示 0~F。通过这个实验，掌握采用 VerilogHDL 语言编程实现 7 段数码管显示译码器的方法。

　　2. 实 验 环 境

　　硬件实验环境为艾米电子工作室型号 EP2C8Q208C8 增强版开发套件。软件实验环境为 Quartus II 8.1 开发软件。

　　3. 实 验 原 理

　　数码管 LED 显示是工程项目中使用较广的一种输出显示器。常见的数码管有共阴和共阳两种。艾米电子工作室开发套件上采用的是共阳极数码管，共阳数码管就是 8 个发光二极管的阳极连接在一起作为公共端。公共端常称为位码，而将其他八位称为段码。本实验先将板载 50M 时钟源进行 24 次分频，然后将分频后的频率作为四位计数器的时钟脉冲信号，使其计数循环输出0~F，最后经 Verilog HDL 编写的译码模块译码后显示于数码管上。

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