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FPGA时钟分配网络设计技术

消耗积分:3 | 格式:rar | 大小:220 | 2010-08-06

胡秋阳

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本文阐述了用于FPGA的可优化时钟分配网络功耗与面积的时钟布线结构模型。并在时钟分配网络中引入数字延迟锁相环减少时钟偏差，探讨了FPGA时钟网络中锁相环的实现方案。
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