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异步时序亚稳态的消除方法设计

消耗积分:0 | 格式:pdf | 大小:511 KB | 2011-05-31

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提出一种基于异步比较法产生空满标志位，并利用锁存器实现标志位与时钟同步的FIFO，同时还给出了相应的VerilogHDL代码。该方法能提高时钟频率，节约版图面积。

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