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基于FPGA的DRR算法的实现

消耗积分:3 | 格式:rar | 大小:140 | 2009-08-07

ejlwj

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考虑到QoS需求以及带宽的有效利用，高速有效的调度算法成为当前路由器中研究
的热点。DRR算法具有较低的设计复杂度以及适应变长分组交换的特点，使之便于在T-Bit路由器中实现。文中介绍了设计的主要模块以及具体的硬件实现方案。
随着IP 宽带技术的不断发展，对路由器的性能也提出了越来越高的要求，同时为了保证IP QoS，如何提供并实现有效的队列调度也成为了研究的热点和难点。队列调度的基本
功能是：在中继节点中，按照不同的调度粒度（scheduling granularity）从节点连接的多个队列中进行选择。 一个有效的队列调度机制取决于它采用的调度算法，衡量调度算法的性能指标主要有：公平性、时延特性、吞吐量、对恶意流的阻隔能力等。这些指标和QoS 是密切相关的，同时为了便于实现，对调度算法的复杂度也有着相应的要求。
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