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基于FPGA快速A 律压缩编码的设计与实现

消耗积分:5 | 格式:rar | 大小:697 | 2010-07-28

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本文针对A律13折线法的算法特点,提出一种并行数据处理算法,实现了编码的流水线操作。运用VHDL语言将其在FPGA中实现,借助quartus II6.0平台进行验证,并对验证结果进行分析,评估了系统的性能,证实了该算法的优越性和高效性。
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