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5.2GHz無線區域網路CMOS低雜訊放大器設計
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2008-10-15
王兰
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隨著科技的進步，人與人之間的聯繫與溝通，已由有線傳送進步到無線傳輸，使得無線
通訊系統(wireless communication system)蓬勃發展。在無線通訊系統中，射頻前端電路(RFfront end)因為操作頻率較高，仍多採用成本高且整合性低的特殊製程，近年來由於CMOS 製程的快速發展，射頻前端電路也逐漸使用製作成本低與系統整合性高的CMOS 製程製作。本論文中，將探討一應用在5.2GHz 無線區域網路(wireless local area network, WLAN)射頻前端的低雜訊放大器(low noise amplifier, LNA)之設計。
吾人利用台灣積體電路製造公司(TSMC)之0.25μm CMOS 製程設計一應用在5.2GHz 無
線區域網路的低雜訊放大器，並透過國家晶片系統設計中心(Chip Implementation Center, CIC)進行實作與測試。吾人所設計的串接式(cascade)低雜訊放大器可提供15dB 的增益、3.4dB 的雜訊指數及26mW 的功率消耗；使用晶片電感(on-chip inductor)的疊接式(cascode)低雜訊放大器提供7dB 的增益、5.86dB 的雜訊指數及7.5mW 的功率消耗；使用打線電感(bond-wireinductor)的疊接式低雜訊放大器提供8.3dB 的增益、5.74dB 的雜訊指數及7.5mW 的功率消耗。
通訊系統(wireless communication system)蓬勃發展。在無線通訊系統中，射頻前端電路(RFfront end)因為操作頻率較高，仍多採用成本高且整合性低的特殊製程，近年來由於CMOS 製程的快速發展，射頻前端電路也逐漸使用製作成本低與系統整合性高的CMOS 製程製作。本論文中，將探討一應用在5.2GHz 無線區域網路(wireless local area network, WLAN)射頻前端的低雜訊放大器(low noise amplifier, LNA)之設計。
吾人利用台灣積體電路製造公司(TSMC)之0.25μm CMOS 製程設計一應用在5.2GHz 無
線區域網路的低雜訊放大器，並透過國家晶片系統設計中心(Chip Implementation Center, CIC)進行實作與測試。吾人所設計的串接式(cascade)低雜訊放大器可提供15dB 的增益、3.4dB 的雜訊指數及26mW 的功率消耗；使用晶片電感(on-chip inductor)的疊接式(cascode)低雜訊放大器提供7dB 的增益、5.86dB 的雜訊指數及7.5mW 的功率消耗；使用打線電感(bond-wireinductor)的疊接式低雜訊放大器提供8.3dB 的增益、5.74dB 的雜訊指數及7.5mW 的功率消耗。
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