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高速异步FIFO的设计与实现

消耗积分:5 | 格式:rar | 大小:223 | 2010-01-13

路过秋天

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本文主要研究了用FPGA 芯片内部的EBRSRAM 来实现异步FIFO 设计方案，重点阐述了
异步FIFO 的标志信号——空/满状态的设计思路，并且用VHDL 语言实现，最后进行了仿真验证。
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