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10-37GHz CMOS四分频器的设计

消耗积分:5 | 格式:rar | 大小:621 | 2010-12-29

石玉兰

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给出基于0.13μm CMOS工艺、采用单时钟动态负载锁存器设计的四分频器。该四分频器由两级二分频器级联而成，级间采用缓冲电路实现隔离和电平匹配。后仿真结果表明其最高工作频率达37GHz，分频范围为27GHz。当电源电压为1.2V、工作频率为37GHz时，其功耗小于30mW，芯片面积为0.33×0.28 mm2 。
Abstract:
 A divide-by-4frequency divider based on single clock dynamic-loading latches in0.13μm complementary-metal-oxide-semiconductor（CMOS）technology is presented.It consists of two levels of divide-by-2frequency divider.A buffer circuit is inserted between them to realize separation and the level matching.The post-simulation shows that it exhibits the maximum operating frequency which is up to37GHz，and achieves a frequency range of27GHz.While operating at37GHz with the1.2V supply voltage，the power dissipation is less than30mW,The chip area is0.33×0.28 mm2
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xuliya 2015-01-01
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