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CDCM1802时钟缓冲器数据表

消耗积分:0 | 格式:pdf | 大小:1.16MB | 2024-08-21

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CDCM1802时钟驱动器将一对差分时钟输入分配给一个LVPECL差分时钟输出对YO和YO，以及一个单端LVCMOS输出Y1。它是专门为驱动50-2传输线而设计的。LVCMOS输出在PECL输出级上延迟1.6 ns，以将信号转换期间的噪声影响降至最低。
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